本文選題：雷達全數(shù)字仿真 + 數(shù)據(jù)劃分��； 參考：《電子科技大學學報》2014年01期

【摘要】：針對順序仿真結構下回波生成與信號處理環(huán)節(jié)軟件仿真速度慢等瓶頸問題,提出一種基于多核處理器共享內存的多數(shù)據(jù)鏈路計算模型,通過構建多數(shù)據(jù)鏈路并行仿真的方法提升軟件仿真效率。根據(jù)同一調度間隔內各雷達事件相互獨立的特性,從數(shù)據(jù)劃分、任務分配、時間同步及負載監(jiān)測與度量等層面上進行闡述。仿真結果表明,該方法與傳統(tǒng)的雷達串行仿真相比,數(shù)據(jù)幀處理平均時間可以降低37.5%,數(shù)據(jù)幀處理加速比曲線表現(xiàn)出良好的仿真加速特性,大大縮減雷達系統(tǒng)仿真時間。
[Abstract]:Aiming at the bottleneck problems such as slow simulation speed of echo generation and signal processing software under sequential simulation structure, a multi-data link computing model based on shared memory of multi-core processors is proposed. The efficiency of software simulation is improved by constructing parallel simulation of multi-data link. According to the independent characteristics of each radar event in the same scheduling interval, the data partition, task allocation, time synchronization, load monitoring and measurement are discussed. The simulation results show that the average time of data frame processing can be reduced by 37.5% compared with the traditional radar serial simulation. The speedup curve of data frame processing shows good simulation acceleration characteristic and greatly reduces the simulation time of radar system.
【作者單位】： 電子科技大學電子科學技術研究院;電子科技大學計算機學院;
【基金】：教育部支撐計劃(625010213)
【分類號】：TP391.9;TN955

【參考文獻】

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【共引文獻】

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7 羅r，

本文編號：1783921