本文選題：OFDM + FPGA　； 參考：《電子科技大學(xué)》2014年碩士論文

【摘要】：本文研究?jī)?nèi)容基于XX研究所合作項(xiàng)目,主要討論了該項(xiàng)目的工程實(shí)現(xiàn)方法,此項(xiàng)目在以FPGA和DSP為核心架構(gòu)的硬件平臺(tái)上完成,本文主要討論其中的FPGA實(shí)現(xiàn)部分以及FPGA與DSP的接口協(xié)議。具體而言,主要包括以下幾方面的工作:(1)根據(jù)已有的matlab仿真程序設(shè)計(jì)發(fā)射機(jī)結(jié)構(gòu),劃分模塊并實(shí)現(xiàn)仿真算法各項(xiàng)功能。介紹發(fā)射機(jī)信號(hào)源處理、數(shù)據(jù)預(yù)處理、信令域處理、峰均比抑制、組幀等模塊的實(shí)現(xiàn)框圖、接口信息、處理流程,并給出仿真時(shí)序圖。然后設(shè)計(jì)中頻發(fā)射模塊,將一定速率的基帶數(shù)字信號(hào)通過數(shù)模轉(zhuǎn)換器轉(zhuǎn)換成模擬信號(hào),調(diào)制信號(hào)到指定中頻頻率并發(fā)射出去。(2)設(shè)計(jì)接收機(jī)中采樣、下變頻、低通濾波及抽取的方案,并恢復(fù)基帶數(shù)據(jù)。介紹接收機(jī)下變頻、低通濾波和抽取、自動(dòng)增益控制、幀同步等模塊的實(shí)現(xiàn)框圖、接口信息和處理流程。(3)設(shè)計(jì)FPGA與DSP之間的數(shù)據(jù)傳輸協(xié)議,介紹接收機(jī)FPGA和DSP的接口定義和數(shù)據(jù)傳輸流程,說明FPGA和DSP的傳輸協(xié)議。(4)給出項(xiàng)目的測(cè)試指標(biāo),介紹峰均比、傳輸帶寬及BER的測(cè)試方案。對(duì)要求的指標(biāo)進(jìn)行測(cè)試并分析測(cè)試結(jié)構(gòu)。對(duì)比測(cè)試結(jié)果與仿真性能,給出最終結(jié)論。
[Abstract]:This paper is based on XX Institute cooperation project, mainly discusses the engineering implementation method of the project, this project is completed on the hardware platform with FPGA and DSP as the core architecture.This paper mainly discusses the part of FPGA implementation and the interface protocol between FPGA and DSP.Specifically, it mainly includes the following aspects: 1) Design the transmitter structure according to the existing matlab simulation program, divide the modules and realize the functions of the simulation algorithm.This paper introduces the block diagram, interface information and processing flow of transmitter signal source processing, data preprocessing, signaling domain processing, peak to average ratio suppression, frame formation and so on, and gives the simulation sequence diagram.Then the intermediate frequency transmitting module is designed, the baseband digital signal of a certain rate is converted into analog signal by digital-analog converter, and the signal is modulated to the designated if frequency and transmitted out.Low-pass filtering and decimation scheme, and recovery of baseband data.The implementation block diagram, interface information and processing flow of receiver down-conversion, low-pass filtering and decimation, automatic gain control, frame synchronization and other modules are introduced to design the data transmission protocol between FPGA and DSP.This paper introduces the interface definition and data transmission flow of receiver FPGA and DSP, explains the transmission protocol of FPGA and DSP. It gives the test index of the project, and introduces the peak to average ratio, transmission bandwidth and the test scheme of BER.Test the required indicators and analyze the test structure.Finally, the final conclusion is given by comparing the test results with the simulation results.
【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2014
【分類號(hào)】：TN791;TN929.53

【共引文獻(xiàn)】

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本文編號(hào)：1753628