本文關(guān)鍵詞： 擴(kuò)展頻譜 猝發(fā)通信 LDPC碼 同步捕獲 FPGA　出處：《西安電子科技大學(xué)》2014年碩士論文　論文類型：學(xué)位論文

【摘要】：隨著人類進(jìn)入現(xiàn)代化社會,怎樣在種種惡劣的情況下進(jìn)行有效地通信是當(dāng)前面臨的一個重大問題。擴(kuò)展頻譜通信技術(shù)作為一種特殊的通信方式在軍事通信中占有重要地位。猝發(fā)通信是在很短的時間內(nèi)發(fā)出信號,靜默狀態(tài)在其它時間,由于突發(fā)時間的任意性,因而具有較強(qiáng)的抗截獲能力。LDPC碼作為一種性能優(yōu)異的信道糾錯碼,已被證明具有逼近香農(nóng)限的潛力。將猝發(fā)通信與擴(kuò)展頻譜以及LDPC碼進(jìn)行有效結(jié)合,能夠滿足高速高性能實時通信系統(tǒng)的需求,是未來深空通信和第四代移動通信中最有前途的解決方案。近年來,隨著EDA技術(shù)的快速發(fā)展和各類FPGA芯片的層出不窮,SoC(片上系統(tǒng))更有利于將上述技術(shù)推向?qū)嶋H應(yīng)用,本文所做的主要工作如下:1.以某猝發(fā)擴(kuò)頻通信系統(tǒng)項目為背景,對接收端數(shù)字濾波器、同步捕獲、數(shù)字鎖相環(huán)等關(guān)鍵技術(shù)給予了理論研究,主要對同步捕獲判決方法進(jìn)行了深入推導(dǎo)和分析并給出了相關(guān)仿真結(jié)果圖。2.采用基于準(zhǔn)循環(huán)矩陣的方法構(gòu)造了一種200×300的LDPC碼校驗矩陣并驗證誤碼性能,在信噪比Eb/N0=2.3dB的條件下采用該LDPC碼進(jìn)行BP譯碼誤幀率可以達(dá)到10-2。3.對上述接收端關(guān)鍵技術(shù)進(jìn)行了Verilog編程實現(xiàn),結(jié)合軟硬件資源和FPGA芯片的處理速度,重點(diǎn)對PMF-FFT方法設(shè)計了一種性能良好、復(fù)雜度低的同步捕獲實現(xiàn)方案。4.為了將上述PMF-FFT同步捕獲方案推向?qū)嶋H應(yīng)用,本論文提出了一種基于信號功率的自適應(yīng)門限判別技術(shù)并加入相關(guān)猝發(fā)擴(kuò)頻系統(tǒng)進(jìn)行測試,經(jīng)測試該方法性能穩(wěn)健、效果良好。
[Abstract]:In recent years , with the rapid development of EDA technology and the processing speed of various kinds of FPGA chips , SoC ( on - chip system ) has been proved to be the most promising solution in future deep space communication and fourth generation mobile communication .

【學(xué)位授予單位】：西安電子科技大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2014
【分類號】：TN914.42

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本文編號：1533450