本文關(guān)鍵詞：手持軟件無(wú)線電平臺(tái)音頻及傳輸驅(qū)動(dòng)設(shè)計(jì)與實(shí)現(xiàn)　出處：《電子科技大學(xué)》2014年碩士論文　論文類型：學(xué)位論文

  更多相關(guān)文章： 軟件無(wú)線電平臺(tái) 音頻 ALSA 數(shù)據(jù)傳輸 GPMC

【摘要】：語(yǔ)音采集與數(shù)據(jù)傳輸是手持式軟件無(wú)線電平臺(tái)的兩個(gè)重要功能,是實(shí)現(xiàn)手持軟件無(wú)線電平臺(tái)實(shí)時(shí)語(yǔ)音通信的基礎(chǔ)。如何實(shí)現(xiàn)音頻數(shù)據(jù)采集與傳輸是實(shí)現(xiàn)手持軟件無(wú)線電平臺(tái)實(shí)時(shí)語(yǔ)音通信需要考慮的重要問(wèn)題。實(shí)現(xiàn)以上兩個(gè)功能,需要解決以下問(wèn)題:分析Linux的音頻驅(qū)動(dòng)構(gòu)架,實(shí)現(xiàn)底層驅(qū)動(dòng),提高驅(qū)動(dòng)程序的可移植性和易用性;簡(jiǎn)化數(shù)據(jù)傳輸協(xié)議,降低開(kāi)發(fā)難度,設(shè)計(jì)實(shí)現(xiàn)ARM與FPGA之間的數(shù)據(jù)傳輸通道。為此,論文從小型軟件無(wú)線電平臺(tái)的實(shí)際應(yīng)用場(chǎng)景出發(fā),以項(xiàng)目組自主研發(fā)、搭載Android操作系統(tǒng)的手持式軟件無(wú)線電平臺(tái)為基礎(chǔ),實(shí)現(xiàn)了音頻數(shù)據(jù)采集以及ARM與FPGA之間數(shù)據(jù)傳輸。論文研究?jī)?nèi)容包括以下幾方面:第一,Linux音頻子系統(tǒng)ALSA的底層驅(qū)動(dòng)實(shí)現(xiàn)。研究ALSA驅(qū)動(dòng)的構(gòu)架及相關(guān)芯片的使用,實(shí)現(xiàn)ALSA底層驅(qū)動(dòng),包括音頻芯片驅(qū)動(dòng)、MCBSP驅(qū)動(dòng),DMA驅(qū)動(dòng),使平臺(tái)支持實(shí)時(shí)語(yǔ)音信號(hào)的采集與回放。第二,搭建ARM與FPGA之間數(shù)據(jù)傳輸?shù)耐ǖ馈Ｍ瓿蒄PGA時(shí)鐘配置及程序加載,為FPGA運(yùn)行搭建基本環(huán)境;以主控芯片DM3730的GPMC模塊為基礎(chǔ),實(shí)現(xiàn)ARM與FPGA雙向數(shù)據(jù)傳輸,建立了處理器間數(shù)據(jù)傳輸?shù)耐ǖ�。第�?應(yīng)用層程序?qū)崿F(xiàn)。應(yīng)用層程序可以實(shí)現(xiàn)音頻數(shù)據(jù)的采集與回放,然后控制DM3730集成的DSP壓縮數(shù)據(jù),最終調(diào)用數(shù)據(jù)傳輸驅(qū)動(dòng)的應(yīng)用層接口發(fā)送數(shù)據(jù)到FPGA。第四,驗(yàn)證音頻驅(qū)動(dòng)及數(shù)據(jù)傳輸驅(qū)動(dòng)。測(cè)試結(jié)果表明,在應(yīng)用層可以成功調(diào)用驅(qū)動(dòng)實(shí)現(xiàn)音頻信號(hào)采集與回放,音頻信號(hào)失真度小于0.3%,音頻驅(qū)動(dòng)正常運(yùn)行;數(shù)據(jù)傳輸驅(qū)動(dòng)可實(shí)現(xiàn)雙向數(shù)據(jù)傳輸,傳輸時(shí)鐘可達(dá)70MHz,驅(qū)動(dòng)及接口工作正常。論文研究的內(nèi)容為手持軟件無(wú)線電平臺(tái)音頻數(shù)據(jù)的采集、傳輸提供了解決方案,依據(jù)方案設(shè)計(jì)的手持式軟件無(wú)線電平臺(tái)在特定的場(chǎng)合具有一定的優(yōu)勢(shì),具有實(shí)際的應(yīng)用價(jià)值。
[Abstract]:In this paper , the realization of data transmission between ARM and FPGA is realized by using the software radio platform of the main control chip DM3730 . The results show that the data transmission between ARM and FPGA is realized by the application layer program . The data transmission drive can realize bidirectional data transmission , and the transmission clock can reach 70MHz . The data transmission channel between ARM and FPGA is realized .

【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2014
【分類號(hào)】：TN912.3;TN919.3

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本文編號(hào)：1424844