本文關(guān)鍵詞：射頻帶通采樣雷達(dá)數(shù)字接收機(jī)的研究與設(shè)計(jì)　出處：《南京理工大學(xué)》2014年碩士論文　論文類型：學(xué)位論文

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【摘要】：L波段航管一次雷達(dá)是確保民航班機(jī)飛行安全的重要空管設(shè)備,為其設(shè)計(jì)高性能的數(shù)字接收機(jī)是非常有意義的。由于受數(shù)字器件水平的限制,中頻采樣是目前雷達(dá)數(shù)字接收機(jī)的主流方案,但這種接收機(jī)需要使用模擬混頻器,復(fù)雜的模擬前端限制了其性能。隨著微電子技術(shù)的高速發(fā)展,射頻帶通采樣結(jié)構(gòu)已經(jīng)可以應(yīng)用于L波段航管雷達(dá)數(shù)字接收機(jī)。這種結(jié)構(gòu)的接收機(jī)沒(méi)有模擬混頻環(huán)節(jié),簡(jiǎn)單的射頻前端使其擁有比中頻采樣數(shù)字接收機(jī)更高的可靠性和穩(wěn)定性。 本文首先介紹了雷達(dá)數(shù)字接收機(jī)的相關(guān)理論,針對(duì)某L波段航管一次雷達(dá)信號(hào)帶寬較窄,載頻變化范圍較大的特點(diǎn),為其設(shè)計(jì)了射頻帶通采樣的數(shù)字接收機(jī)方案,具體包括采樣方案、正交變換方案、可控變頻方案和抽取濾波方案,并對(duì)方案進(jìn)行了相應(yīng)的MATLAB仿真。然后在ALTERA公司的FPGA芯片EP4SGX230上實(shí)現(xiàn)了接收機(jī)數(shù)字前端,包含正交變換模塊、可控變頻模塊和多級(jí)抽取濾波模塊。本文對(duì)接收機(jī)的硬件設(shè)計(jì)和FPGA開(kāi)發(fā)設(shè)計(jì)進(jìn)行了研究,調(diào)試結(jié)果表明,系統(tǒng)方案切實(shí)可行,設(shè)計(jì)滿足要求。
[Abstract]:L band primary surveilence radar is an important equipment to ensure the flight safety of civil aviation air traffic control, the design of high performance digital receiver for it is very significant. Due to the limitation of digital devices, if sampling is the main method of radar digital receiver, but the receiver needs to use analog mixer, analog front-end complex limited its performance. With the rapid development of microelectronics, RF bandpass sampling structure can be applied in L band ATC radar digital receiver. The receiver structure no analog mixing link, RF front-end simple to have than if sampling digital receiver with higher reliability and stability.
This paper firstly introduces the related theories of radar digital receiver, a L band primary surveilence radar signal with narrow bandwidth, carrier frequency variation characteristics of digital receiver scheme for the design of RF bandpass sampling, including sampling scheme, orthogonal transformation scheme, controllable frequency scheme and decimation filter scheme, and has carried on the corresponding MATLAB simulation. Then in the ALTERA company's FPGA chip EP4SGX230 to realize the digital receiver, including orthogonal transform module, conversion module and controllable multi-stage decimation filter module. The receiver hardware design and FPGA machine were studied. The debugging results show that the proposed method is feasible and the design meet requirements.

【學(xué)位授予單位】：南京理工大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2014
【分類號(hào)】：TN957.5

【參考文獻(xiàn)】

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本文編號(hào)：1412074