本文關(guān)鍵詞：基于FPGA的DBPSK通信系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)　出處：《中國民航大學(xué)》2014年碩士論文　論文類型：學(xué)位論文

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【摘要】：差分二進(jìn)制相移鍵控(DBPSK)是現(xiàn)代通信領(lǐng)域廣泛應(yīng)用的調(diào)制方式,常被應(yīng)用于衛(wèi)星通信、微波通信等諸多領(lǐng)域。近年來,隨著大規(guī)模集成電路和軟件無線電技術(shù)的發(fā)展,DBPSK調(diào)制與解調(diào)在無線通信領(lǐng)域取得了廣泛應(yīng)用。本文對DBPSK通信系統(tǒng)進(jìn)行研究并采用FPGA實(shí)現(xiàn)該系統(tǒng)。論文主要開展四個(gè)方面的工作:首先,根據(jù)數(shù)字通信理論,提出DBPSK通信系統(tǒng)的設(shè)計(jì)方案,其中主要包括系統(tǒng)參數(shù)、物理層數(shù)據(jù)幀結(jié)構(gòu)以及發(fā)射機(jī)架構(gòu)和接收機(jī)架構(gòu)的設(shè)計(jì)。其次,詳細(xì)描述了系統(tǒng)發(fā)射機(jī)與接收機(jī)的組成模塊和相關(guān)參數(shù),并利用Matlab仿真系統(tǒng)。在此基礎(chǔ)上提出系統(tǒng)的FPGA實(shí)現(xiàn)方案并采用Verilog語言加以實(shí)現(xiàn)。再次,分析了上下變頻器和科斯塔斯(Costas)載波同步環(huán)的理論,通過Matlab仿真獲得關(guān)鍵的設(shè)計(jì)參數(shù),并利用Verilog語言完成上下變頻器和科斯塔斯載波同步環(huán)的FPGA實(shí)現(xiàn)。最后,在Xilinx公司Virtex 5的FPGA開發(fā)板上進(jìn)行硬件實(shí)現(xiàn)并通過在線邏輯分析儀觀測FPGA內(nèi)部信號,完成系統(tǒng)性能的檢測。
[Abstract]:Differential binary phase shift keying (DBPSK) modulation is widely used in the field of modern communication, is often used in satellite communications, microwave communications and other fields. In recent years, with the development of integrated circuit and software radio technology, DBPSK modulation and demodulation has been widely applied in the field of wireless communications is studied in this paper. The DBPSK communication system and the FPGA implementation of this system. This paper mainly carried out in four aspects: first, according to the digital communication theory, puts forward the design scheme of DBPSK communication system, including system parameters, physical layer data frame structure and transmitter architecture and receiver architecture design. Secondly, the module system and transmitter the receiver and the related parameters are described in detail, and the use of Matlab simulation system. Based on this system the implementation scheme of FPGA and using Verilog language to realize. Second, analysis of the upper and lower frequency converter and Kostas (Costas) carrier synchronization loop theory, the key design parameters are obtained by Matlab simulation, and the use of Verilog language to complete the FPGA downconverter and Kostas carrier synchronization loop. Finally, in the Xilinx Virtex FPGA 5 development board for hardware implementation and through online logic analyzer the observation of FPGA signals, complete the detection performance of the system.

【學(xué)位授予單位】：中國民航大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2014
【分類號】：TN914

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本文編號：1409598