本文關(guān)鍵詞：高速多通道數(shù)據(jù)傳輸系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn)　出處：《中北大學(xué)》2015年碩士論文　論文類(lèi)型：學(xué)位論文

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【摘要】：當(dāng)前，隨著空間飛行器遙測(cè)、雷達(dá)通信、測(cè)控等應(yīng)用過(guò)程中所需的數(shù)據(jù)傳輸帶寬和傳輸數(shù)據(jù)量的增大，其相應(yīng)的數(shù)據(jù)傳輸系統(tǒng)被要求具備高速率的數(shù)據(jù)收發(fā)特性和大容量存儲(chǔ)功能，這樣才能達(dá)到相關(guān)應(yīng)用領(lǐng)域中對(duì)數(shù)據(jù)、信息以及指令的傳輸要求。本課題來(lái)源于雷達(dá)測(cè)試項(xiàng)目，在其測(cè)試系統(tǒng)中要求具有高速、大容量、穩(wěn)定的數(shù)據(jù)傳輸系統(tǒng)。 針對(duì)雷達(dá)測(cè)試系統(tǒng)中的中頻數(shù)字化接收機(jī)與計(jì)算機(jī)之間高速、大容量、穩(wěn)定的數(shù)據(jù)傳輸問(wèn)題，本課題通過(guò)對(duì)當(dāng)前已有的數(shù)據(jù)傳輸技術(shù)進(jìn)行調(diào)研與分析，研制了一種基于FPGA設(shè)計(jì)與實(shí)現(xiàn)的高速多通道傳輸系統(tǒng)。該數(shù)據(jù)傳輸系統(tǒng)以Kintex-7系列FPGA為核心控制器，，為了匹配接收機(jī)傳輸接口，通過(guò)對(duì)8通道LVDS接口電路的邏輯控制實(shí)現(xiàn)數(shù)據(jù)收發(fā)；為了滿足大容量、高速的數(shù)據(jù)傳輸，通過(guò)MIG控制器對(duì)DDR3SDRAM控制實(shí)現(xiàn)大容量數(shù)據(jù)緩存；同時(shí)，利用FPGA內(nèi)嵌的IP Core以PCI-E DMA方式實(shí)現(xiàn)與計(jì)算機(jī)之間指令、數(shù)據(jù)的高速傳輸。本課題著重介紹了傳輸系統(tǒng)各功能模塊硬件設(shè)計(jì)、FPGA邏輯控制方案，并且搭建了測(cè)試平臺(tái)，通過(guò)計(jì)算機(jī)應(yīng)用程序、ChipScope調(diào)試軟件、數(shù)據(jù)文件分析軟件對(duì)傳輸系統(tǒng)的性能進(jìn)行了測(cè)試與驗(yàn)證，最終實(shí)現(xiàn)了高速多通道數(shù)據(jù)傳輸系統(tǒng)的設(shè)計(jì)。 結(jié)果表明本課題所設(shè)計(jì)的高速多通道數(shù)據(jù)傳輸系統(tǒng)工作正常，在數(shù)據(jù)上傳和下發(fā)過(guò)程中數(shù)據(jù)傳輸速率均能達(dá)到1000MB/s，其能夠滿足當(dāng)前雷達(dá)測(cè)試系統(tǒng)對(duì)高速、大容量、穩(wěn)定的數(shù)據(jù)傳輸要求，具有高的實(shí)用價(jià)值。
[Abstract]:At present , with the increase of the data transmission bandwidth and the transmission data quantity required in the application of space vehicle telemetry , radar communication and measurement and control , the corresponding data transmission system is required to have high - rate data transmission / reception characteristics and large - capacity storage function so as to meet the transmission requirements of data , information and instructions in the related application field . A high - speed , high - speed , high - speed , high - speed data transmission system based on FPGA is developed for high - speed , large - capacity and stable data transmission between IF digital receiver and computer in radar test system . In order to meet the high - capacity and high - speed data transmission , a high - capacity data cache is realized through the logic control of 8 - channel LVDS interface circuit . In order to meet the high - capacity and high - speed data transmission , the hardware design of each functional module of the transmission system and the high - speed transmission of data are realized . The results show that the high - speed multi - channel data transmission system designed by the project is normal , and the data transmission rate can reach 1000MB / s during data uploading and distribution , which can meet the requirement of high - speed , large - capacity and stable data transmission of the current radar test system , and has high practical value .

【學(xué)位授予單位】：中北大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2015
【分類(lèi)號(hào)】：TN919.3

【參考文獻(xiàn)】

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本文編號(hào)：1359971