本文關(guān)鍵詞：基于FPGA的高速圖像傳輸系統(tǒng)設(shè)計(jì)（英文）

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【摘要】：提出一種多相機(jī)的高速圖像傳輸方法,以克服目前采用LVDS方式進(jìn)行長(zhǎng)距離圖像傳輸技術(shù)存在的所需線纜數(shù)量大、同時(shí)需要進(jìn)行數(shù)據(jù)中繼、系統(tǒng)的復(fù)雜度高的缺陷。系統(tǒng)采用FPGA為主控制器,將接收到的高速相機(jī)發(fā)出的LVDS格式圖像數(shù)據(jù)轉(zhuǎn)換成TTL信號(hào),并分別輸入到指定的存儲(chǔ)區(qū)中。將相應(yīng)存儲(chǔ)區(qū)中的圖像數(shù)據(jù)進(jìn)行打包處理,送入RocketI O中轉(zhuǎn)換為高速串行數(shù)據(jù)后,利用光纖進(jìn)行遠(yuǎn)距離傳輸。實(shí)驗(yàn)表明,該方法在1.6 Gbps的傳輸速率下,傳輸數(shù)據(jù)量為32 Gbit時(shí),誤碼數(shù)為零,且系統(tǒng)設(shè)計(jì)簡(jiǎn)單、性能優(yōu)良,具有較強(qiáng)的可擴(kuò)展性。
【作者單位】： 中國(guó)科學(xué)院長(zhǎng)春光學(xué)精密機(jī)械與物理研究所;
【基金】：吉林省科技發(fā)展計(jì)劃資助項(xiàng)目(20130522107JH)
【分類號(hào)】：TN919.8
【正文快照】： merges the clock and data to transmit and overcome0 Introductionthe problem of clock jitter and data jitter.No clockcontrolling signal can greatly increase the transmissionWith the continuous improvement of electronicspeed,reduce the peripheral IC pin co

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【相似文獻(xiàn)】

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2 聶p，

本文編號(hào)：1292258