本文關(guān)鍵詞：基于FPGA的雷達干擾效果評估接收機設(shè)計

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【摘要】：測試雷達干擾設(shè)備性能得到雷達干擾效果評估結(jié)果,就要完成加干擾后雷達信號的特征參數(shù)提取.介紹了一種基于高速A/D、FPGA、串口組成的雷達干擾效果評估接收機.其接收經(jīng)過微波前端處理得到的中頻信號,通過A/D采樣,再利用FPGA系統(tǒng)得到功率、脈寬、帶寬時延等參數(shù).信息的測試結(jié)果通過串口上報給上位機以完成干擾效果的估計.
【作者單位】： 哈爾濱工程大學(xué)信息與通信工程學(xué)院;
【關(guān)鍵詞】： FPGA CORDIC 干擾效果評估接收機
【基金】：中央高校基本科研費專項基金(HEUCF140803)
【分類號】：TN791;TN974
【正文快照】： 干擾效果評估是指對雷達信號進行干擾以后,定性或定量的對其產(chǎn)生的干擾效果的評價[1].干擾效果評估是對實戰(zhàn)、試驗及電子對抗設(shè)備的研制都很重要的一項用來衡量雷達干擾設(shè)備干擾性能的綜合性指標[2].想要對干擾效果進行評估就必須要提取加擾后的雷達信號的特征參數(shù),基于這些參

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本文編號：1107840