本文關(guān)鍵詞：基于ESL的多核雷達(dá)信號(hào)處理芯片的架構(gòu)探索

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【摘要】：針對(duì)高性能多核雷達(dá)信號(hào)處理芯片寄存器傳輸級(jí)設(shè)計(jì)調(diào)試周期長(zhǎng)、高成本等特點(diǎn),提出一套在寄存器傳輸級(jí)設(shè)計(jì)之前使用,基于電子系統(tǒng)級(jí)設(shè)計(jì)的多核建模和架構(gòu)探索方法,在寄存器傳輸級(jí)設(shè)計(jì)前期能夠進(jìn)行可靠架構(gòu)探索和性能分析,便于軟硬件協(xié)同設(shè)計(jì)。從多核架構(gòu)探索流程、數(shù)據(jù)流探索方法、具有向量處理功能的數(shù)字信號(hào)處理核/異構(gòu)核的周期精度模擬器建模、多核一致性總線協(xié)議探索和總線建模及驗(yàn)證方案、全芯片電子系統(tǒng)級(jí)建模等方面論述該方法的具體實(shí)現(xiàn),結(jié)合實(shí)例驗(yàn)證了其可行性。
【作者單位】： 清華大學(xué)微電子學(xué)研究所;
【關(guān)鍵詞】： 電子系統(tǒng)級(jí) 多核 數(shù)據(jù)流 周期精度建模 總線系統(tǒng)
【基金】：核高基重大專項(xiàng)基金項(xiàng)目(2012ZX01034001-002)
【分類號(hào)】：TN957.51;TP332.11
【正文快照】： 0引言本文以基于雷達(dá)應(yīng)用的華睿2號(hào)(HR-2)高性能異構(gòu)多核處理器SoC(system on chip)作為項(xiàng)目背景,采用ESL(electronic system level)設(shè)計(jì)方法,利用Synopsys公司的PA/PD(platform architect/processor designer)開(kāi)發(fā)平臺(tái),進(jìn)行基于SystemC和LISA的全芯片事務(wù)級(jí)建模,完整設(shè)計(jì)了一

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中國(guó)期刊全文數(shù)據(jù)庫(kù) 前10條

1 ;西安電子科技大學(xué)雷達(dá)信號(hào)處理國(guó)家級(jí)重點(diǎn)實(shí)驗(yàn)室簡(jiǎn)介[J];雷達(dá)學(xué)報(bào);2012年03期

2 ;《雷達(dá)信號(hào)處理重點(diǎn)實(shí)驗(yàn)室基金》簡(jiǎn)介[J];西安電子科技大學(xué)學(xué)報(bào);1997年S1期

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4 孫曉聞,張林讓,吳順君;脈沖多卜勒雷達(dá)信號(hào)處理系統(tǒng)的仿真[J];系統(tǒng)仿真學(xué)報(bào);2002年11期

5 劉偉,李海,曾濤;面向?qū)ο笸ㄓ美走_(dá)信號(hào)處理程序框架的設(shè)計(jì)與實(shí)現(xiàn)[J];北京理工大學(xué)學(xué)報(bào);2004年08期

6 何賓,汪曉男;一種雷達(dá)信號(hào)處理系統(tǒng)新體系結(jié)構(gòu)的設(shè)計(jì)[J];現(xiàn)代雷達(dá);2004年10期

7 楊s，

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