本文關(guān)鍵詞：一種DSP芯片SOC總線的功能驗證

  更多相關(guān)文章： AHB總線協(xié)議 AXI總線協(xié)議 SOC總線 功能驗證

【摘要】：本文通過比較兩種AMBA總線協(xié)議——AHB總線協(xié)議和AXI總線協(xié)議,給出兩種不同的SOC總線方案,并對這兩種總線方案進行功能驗證,以確保SOC總線能夠在核、DMA、外設(shè)組、外部存儲器和L2存儲器之間正確的傳遞信息,并支持系統(tǒng)寄存器對SOC總線的仲裁進行配置。同時要確保SOC總線能夠支持功能模塊之間各種類型的數(shù)據(jù)傳輸,確保信號在不同時鐘域之間的正確傳遞,還要確保傳輸延時符合設(shè)計要求。 SOC總線是由IP核構(gòu)建的,所以在對SOC總線進行功能驗證之前,必須先驗證IP核。AHB總線相關(guān)的IP模塊主要有AHB總線模塊、AHB總線橋模塊以及AHB總線互連模塊。AHB總線模塊的功能是完成Master到Slave的數(shù)據(jù)傳輸,驗證結(jié)果表明功能和傳輸延時都符合設(shè)計要求。AHB總線橋模塊的功能是完成兩條總線之間的數(shù)據(jù)傳輸,可以實現(xiàn)不同時鐘域之間的數(shù)據(jù)傳輸。AHB總線橋模塊有兩種：eh2h和h2h。eh2h總線橋包含F(xiàn)IFO,驗證結(jié)果表明傳輸延時較大,但支持突發(fā)傳輸。h2h總線橋不包含F(xiàn)IFO,驗證結(jié)果表明傳輸延時較小,但不支持突發(fā)傳輸,只能一個一個的傳輸。AHB總線互連模塊的功能是完成不同總線訪問同一個目的地時的仲裁,驗證結(jié)果表明功能和傳輸延時都符合設(shè)計要求。AXI總線相關(guān)的IP模塊主要有AXI總線模塊和AXI總線橋模塊。AXI總線模塊的功能是完成Master到Slave的數(shù)據(jù)傳輸,而AXI總線橋模塊的功能是完成兩條總線之間的數(shù)據(jù)傳輸。對AXI總線相關(guān)的IP模塊進行功能驗證的結(jié)果表明功能和傳輸延時都符合設(shè)計要求。 本文基于兩種總線協(xié)議構(gòu)建了兩種SOC總線。一種是完全由AHB總線協(xié)議構(gòu)建的,這種SOC總線的Master端和Slave端都使用AHB總線協(xié)議的信號,完全由AHB總線相關(guān)的IP模塊構(gòu)成。對于這種SOC總線選取了核相關(guān)總線、DMA相關(guān)總線和PAB總線進行功能驗證,驗證結(jié)果表明功能都符合設(shè)計要求,但傳輸延時太長,不符合設(shè)計要求。另一種SOC總線是由AHB總線協(xié)議和AXI總線協(xié)議共同構(gòu)建的,這種SOC總線的Master端使用AXI總線協(xié)議的信號,Slave端使用AHB總線協(xié)議的信號。對于這種SOC總線同樣選取了核相關(guān)總線、DMA相關(guān)總線和PAB總線進行功能驗證,驗證結(jié)果表明功能和傳輸延時都符合設(shè)計要求。
【關(guān)鍵詞】：AHB總線協(xié)議 AXI總線協(xié)議 SOC總線 功能驗證
【學(xué)位授予單位】：北京交通大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2014
【分類號】：TP336
【目錄】：

• 致謝5-6
• 中文摘要6-7
• ABSTRACT7-9
• 序9-13
• 1 引言13-17
• 1.1 課題背景13-14
• 1.2 國內(nèi)外研究現(xiàn)狀14
• 1.3 研究方法14-16
• 1.4 章節(jié)安排16-17
• 2 AHB總線協(xié)議17-49
• 2.1 AMBAAHB協(xié)議17-25
• 2.1.1 AHB基本傳輸18-22
• 2.1.2 Slave傳輸響應(yīng)22-23
• 2.1.3 仲裁機制23-25
• 2.1.4 地址解碼25
• 2.2 AHB總線模塊25-31
• 2.2.1 總線模塊簡介26-27
• 2.2.2 信號說明27-28
• 2.2.3 AHB總線的Lite模式28
• 2.2.4 功能驗證28-31
• 2.3 AHB總線橋模塊(eh2h)31-39
• 2.3.1 總線橋模塊簡介31-32
• 2.3.2 信號說明32-34
• 2.3.3 功能驗證34-38
• 2.3.4 總線橋模塊的幾個問題38-39
• 2.4 AHB總線橋模塊(h2h)39-43
• 2.4.1 總線橋模塊簡介39-40
• 2.4.2 信號說明40-41
• 2.4.3 功能驗證41-43
• 2.4.4 AHB總線橋的選擇43
• 2.5 AHB總線互連模塊43-48
• 2.5.1 總線互連模塊簡介44-45
• 2.5.2 信號說明45-46
• 2.5.3 功能驗證46-48
• 本章小結(jié)48-49
• 3 AXI總線協(xié)議49-69
• 3.1 AMBAAXI協(xié)議49-58
• 3.1.1 AXI基本傳輸50-54
• 3.1.2 通道握手54-56
• 3.1.3 原子訪問56-58
• 3.1.4 亂序傳輸58
• 3.2 AXI總線模塊58-63
• 3.2.1 總線模塊簡介59-60
• 3.2.2 信號說明60-61
• 3.2.3 功能驗證61-63
• 3.3 AXI總線橋模塊63-67
• 3.3.1 總線橋模塊簡介63-64
• 3.3.2 信號說明64-65
• 3.3.3 功能驗證65-67
• 本章小結(jié)67-69
• 4 SOC總線及功能驗證69-95
• 4.1 SOC總線簡介69-75
• 4.1.1 處理器內(nèi)核相關(guān)總線70-72
• 4.1.2 DMA控制器相關(guān)總線72-74
• 4.1.3 外設(shè)訪問總線74-75
• 4.2 由AHB構(gòu)建的SOC總線75-85
• 4.2.1 核相關(guān)總線及功能驗證75-79
• 4.2.2 DMA相關(guān)總線及功能驗證79-82
• 4.2.3 PAB總線及功能驗證82-85
• 4.3 由AHB和AXI構(gòu)建的SOC總線85-92
• 4.3.1 核相關(guān)總線及功能驗證86-90
• 4.3.2 DMA相關(guān)總線及功能驗證90-91
• 4.3.3 PAB總線及功能驗證91-92
• 本章小結(jié)92-95
• 5 結(jié)論95-97
• 參考文獻97-99
• 索引99-101
• 作者簡歷101-105
• 學(xué)位論文數(shù)據(jù)集105

【參考文獻】

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本文編號：657557