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基于UVM的CPU卡芯片驗(yàn)證平臺(tái)

發(fā)布時(shí)間:2017-06-24 01:12

  本文關(guān)鍵詞:基于UVM的CPU卡芯片驗(yàn)證平臺(tái),,由筆耕文化傳播整理發(fā)布。


【摘要】:介紹了一種基于UVM(Universal Verification Methodology)驗(yàn)證方法學(xué)的驗(yàn)證平臺(tái).該驗(yàn)證平臺(tái)是針對(duì)基于自主知識(shí)產(chǎn)權(quán)的國(guó)產(chǎn)MCU C0的CPU卡芯片的功能驗(yàn)證需求所搭建的.該驗(yàn)證平臺(tái)采用面向?qū)ο蟮膶哟位慕7椒?完成了符合ISO14443協(xié)議的驗(yàn)證事務(wù),通用功能驗(yàn)證組件以及設(shè)計(jì)參考模型的建模;能實(shí)時(shí)監(jiān)測(cè)設(shè)計(jì)中信號(hào)的變化,能實(shí)現(xiàn)在驗(yàn)證過(guò)程中驗(yàn)證結(jié)果的自動(dòng)對(duì)比,能根據(jù)覆蓋率調(diào)整驗(yàn)證的進(jìn)程.驗(yàn)證結(jié)果表明,該驗(yàn)證平臺(tái)具有復(fù)用性,提升了芯片驗(yàn)證的效率和可靠性.
【作者單位】: 南通大學(xué)江蘇省專用集成電路設(shè)計(jì)重點(diǎn)實(shí)驗(yàn)室;
【關(guān)鍵詞】UVM驗(yàn)證方法學(xué) CPU卡芯片 System verilog 功能驗(yàn)證
【基金】:江蘇省物聯(lián)網(wǎng)和新一代信息技術(shù)研發(fā)及產(chǎn)業(yè)化項(xiàng)目(su2013-137) 江蘇省高校自然科學(xué)研究重大項(xiàng)目(13kj510005) 南通大學(xué)研究生科技計(jì)劃項(xiàng)目(yk1402)
【分類號(hào)】:TP332
【正文快照】: 1引言隨著大規(guī)模集成電路技術(shù)的不斷發(fā)展,數(shù)字集成電路的規(guī)模不斷增大,功能不斷增強(qiáng),這給驗(yàn)證完備性帶來(lái)了更大的挑戰(zhàn).同時(shí)隨著市場(chǎng)競(jìng)爭(zhēng)的日益激烈,芯片從研發(fā)到上市的周期不斷縮短,這對(duì)于驗(yàn)證的效率又提出了更高的要求[1-2].驗(yàn)證技術(shù)一直在發(fā)展,從早前的e語(yǔ)言、verilog語(yǔ)言到

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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中國(guó)碩士學(xué)位論文全文數(shù)據(jù)庫(kù) 前3條

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2 黃萍芳;基于VMM的智能卡系統(tǒng)級(jí)驗(yàn)證[D];西安電子科技大學(xué);2014年

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【二級(jí)參考文獻(xiàn)】

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8 呂欣欣;劉淑芬;;基于SynoTPys VMM方法的FPGA驗(yàn)證技術(shù)[J];計(jì)算機(jī)應(yīng)用;2009年09期

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中國(guó)碩士學(xué)位論文全文數(shù)據(jù)庫(kù) 前3條

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【相似文獻(xiàn)】

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2 詹文法,馬俊,張溯,許修兵;一種可重用的驗(yàn)證平臺(tái)結(jié)構(gòu)[J];微機(jī)發(fā)展;2005年03期

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4 期彤;;新思科技設(shè)計(jì)系統(tǒng)、驗(yàn)證平臺(tái)雙線出擊[J];電子設(shè)計(jì)應(yīng)用;2009年05期

5 張健;黃蓓;王玉艷;;交換控制電路功能驗(yàn)證平臺(tái)設(shè)計(jì)[J];計(jì)算機(jī)工程;2006年16期

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10 王紅衛(wèi);占楊林;梁利平;;以覆蓋率為導(dǎo)向的自動(dòng)化驗(yàn)證平臺(tái)[J];電子測(cè)試;2013年05期

中國(guó)重要會(huì)議論文全文數(shù)據(jù)庫(kù) 前6條

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2 華靜;;虛擬化技術(shù)構(gòu)建金融云業(yè)務(wù)驗(yàn)證平臺(tái)[A];2013年中國(guó)通信學(xué)會(huì)信息通信網(wǎng)絡(luò)技術(shù)委員會(huì)年會(huì)論文集[C];2013年

3 徐文進(jìn);田澤;;基于AFDX-ES SOC驗(yàn)證平臺(tái)的向量中斷控制器驗(yàn)證研究[A];第十六屆計(jì)算機(jī)工程與工藝年會(huì)暨第二屆微處理器技術(shù)論壇論文集[C];2012年

4 淮治華;田澤;趙強(qiáng);韓煒;;基于DSP的SoC FPGA原型驗(yàn)證平臺(tái)的構(gòu)建與應(yīng)用[A];第十五屆計(jì)算機(jī)工程與工藝年會(huì)暨第一屆微處理器技術(shù)論壇論文集(A輯)[C];2011年

5 陳小龍;荊濤;;如何在FPGA或ASIC設(shè)計(jì)中用TCL為HDL模型搭建自動(dòng)驗(yàn)證平臺(tái)[A];全國(guó)第一屆嵌入式技術(shù)聯(lián)合學(xué)術(shù)會(huì)議論文集[C];2006年

6 iJ淑媚;灻斐章;周佩廷;R壭憔

本文編號(hào):476778


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