基于UVM的CPU卡芯片驗證平臺
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【摘要】:介紹了一種基于UVM(Universal Verification Methodology)驗證方法學(xué)的驗證平臺.該驗證平臺是針對基于自主知識產(chǎn)權(quán)的國產(chǎn)MCU C0的CPU卡芯片的功能驗證需求所搭建的.該驗證平臺采用面向?qū)ο蟮膶哟位慕7椒?完成了符合ISO14443協(xié)議的驗證事務(wù),通用功能驗證組件以及設(shè)計參考模型的建模;能實時監(jiān)測設(shè)計中信號的變化,能實現(xiàn)在驗證過程中驗證結(jié)果的自動對比,能根據(jù)覆蓋率調(diào)整驗證的進(jìn)程.驗證結(jié)果表明,該驗證平臺具有復(fù)用性,提升了芯片驗證的效率和可靠性.
【作者單位】: 南通大學(xué)江蘇省專用集成電路設(shè)計重點實驗室;
【關(guān)鍵詞】: UVM驗證方法學(xué) CPU卡芯片 System verilog 功能驗證
【基金】:江蘇省物聯(lián)網(wǎng)和新一代信息技術(shù)研發(fā)及產(chǎn)業(yè)化項目(su2013-137) 江蘇省高校自然科學(xué)研究重大項目(13kj510005) 南通大學(xué)研究生科技計劃項目(yk1402)
【分類號】:TP332
【正文快照】: 1引言隨著大規(guī)模集成電路技術(shù)的不斷發(fā)展,數(shù)字集成電路的規(guī)模不斷增大,功能不斷增強(qiáng),這給驗證完備性帶來了更大的挑戰(zhàn).同時隨著市場競爭的日益激烈,芯片從研發(fā)到上市的周期不斷縮短,這對于驗證的效率又提出了更高的要求[1-2].驗證技術(shù)一直在發(fā)展,從早前的e語言、verilog語言到
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本文編號:476778
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