8086微處理器IP軟核設(shè)計技術(shù)的研究
發(fā)布時間:2023-02-09 17:06
集成電路進(jìn)入SoC階段以后,基于IP核重用的SoC設(shè)計方法已經(jīng)成為目前SoC設(shè)計方法主流之一。我國集成電路設(shè)計產(chǎn)業(yè)起步較晚,設(shè)計水平、設(shè)計能力與國外有一定差距,因此設(shè)計開發(fā)具有自主知識產(chǎn)權(quán)的IP核,對我國的集成電路產(chǎn)業(yè)具有重要的意義。 微處理器是當(dāng)代最重要的發(fā)明之一。在后PC時代,微處理器作為SoC中不可或缺的組成部分,已經(jīng)進(jìn)入了社會生活的各個方面,也在一定程度上代表了一個國家集成電路產(chǎn)業(yè)水平。因為Intel的x86系列微處理器是目前應(yīng)用最為廣泛的微處理器產(chǎn)品,所以設(shè)計一款兼容x86的微處理器產(chǎn)品將會具有良好的應(yīng)用前景,同時完成這一工作對提升我國微處理器設(shè)計技術(shù)有一定經(jīng)驗積累作用。 論文的主要工作集中在16位微處理器HGD 8086 IP軟核的設(shè)計與仿真驗證過程,包括: <1>HGD 8086微處理器IP軟核的系統(tǒng)結(jié)構(gòu)劃分、系統(tǒng)時序以及指令集的設(shè)置,要求與標(biāo)準(zhǔn)8086兼容。 <2>采用若干改進(jìn)方案來優(yōu)化系統(tǒng)架構(gòu)設(shè)計,提高HGD 8086 IP軟核的性能指標(biāo)。 <3>使用Verilog HDL語言完成HGD 8086 IP軟核中ALU模塊、MUL模塊和...
【文章頁數(shù)】:75 頁
【學(xué)位級別】:碩士
【文章目錄】:
摘要
Abstract
致謝
第一章 緒論
1.1 課題研究背景
1.1.1 快速發(fā)展的微電子學(xué)科
1.1.2 微處理器的發(fā)展?fàn)顩r
1.1.3 SoC設(shè)計與IP標(biāo)準(zhǔn)化
1.2 課題意義、研究內(nèi)容
1.2.1 課題意義
1.2.2 課題研究內(nèi)容
1.3 論文結(jié)構(gòu)
第二章 HGD 8086 IP軟核設(shè)計方法的研究
2.1 數(shù)字IC設(shè)計方法學(xué)
2.1.1 基于時序驅(qū)動的設(shè)計方法
2.1.2 基于平臺的設(shè)計方法
2.1.3 基于IP復(fù)用的設(shè)計方法
2.2 HGD 8086 IP軟核的設(shè)計流程
2.2.1 系統(tǒng)級設(shè)計
2.2.2 RTL級設(shè)計
2.2.3 綜合
2.2.4 系統(tǒng)實現(xiàn)
2.3 EDA軟件設(shè)計工具
2.3.1 集成電路設(shè)計自動化
2.3.2 HGD 8086 IP軟核設(shè)計工具
2.4 本章小結(jié)
第三章 HGD 8086 IP軟核的設(shè)計
3.1 概述
3.2 HGD 8086 IP軟核的系統(tǒng)級設(shè)計
3.2.1 外特性
3.2.2 系統(tǒng)級設(shè)計
3.3 指令系統(tǒng)
3.3.1 指令格式和指令編碼
3.3.2 尋址方式
3.3.3 指令集
3.4 總線接口時序
3.4.1 兼容的總線接口時序
3.4.2 改進(jìn)的總線接口時序
3.5 RTL級設(shè)計
3.5.1 設(shè)計樹狀圖
3.5.2 配置文件CONFIG
3.5.3 數(shù)據(jù)通路
3.5.4 控制通路
3.6 本章小結(jié)
第四章 HGD 8086 IP軟核的仿真與驗證
4.1 概述
4.2 驗證平臺的搭建
4.3 HGD 8086 IP的仿真與驗證
4.3.1 HGD 8086的驗證平臺
4.3.2 啟動功能測試
4.3.3 指令集測試
4.3.4 復(fù)雜功能測試
4.3.5 代碼覆蓋率
4.4 FPGA功能驗證
4.4.1 驗證環(huán)境
4.4.2 FPGA功能驗證結(jié)果
4.5 本章小結(jié)
第五章 總結(jié)與展望
5.1 總結(jié)
5.2 展望
參考文獻(xiàn)
攻讀碩士學(xué)位期間發(fā)表的論文
本文編號:3738920
【文章頁數(shù)】:75 頁
【學(xué)位級別】:碩士
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摘要
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致謝
第一章 緒論
1.1 課題研究背景
1.1.1 快速發(fā)展的微電子學(xué)科
1.1.2 微處理器的發(fā)展?fàn)顩r
1.1.3 SoC設(shè)計與IP標(biāo)準(zhǔn)化
1.2 課題意義、研究內(nèi)容
1.2.1 課題意義
1.2.2 課題研究內(nèi)容
1.3 論文結(jié)構(gòu)
第二章 HGD 8086 IP軟核設(shè)計方法的研究
2.1 數(shù)字IC設(shè)計方法學(xué)
2.1.1 基于時序驅(qū)動的設(shè)計方法
2.1.2 基于平臺的設(shè)計方法
2.1.3 基于IP復(fù)用的設(shè)計方法
2.2 HGD 8086 IP軟核的設(shè)計流程
2.2.1 系統(tǒng)級設(shè)計
2.2.2 RTL級設(shè)計
2.2.3 綜合
2.2.4 系統(tǒng)實現(xiàn)
2.3 EDA軟件設(shè)計工具
2.3.1 集成電路設(shè)計自動化
2.3.2 HGD 8086 IP軟核設(shè)計工具
2.4 本章小結(jié)
第三章 HGD 8086 IP軟核的設(shè)計
3.1 概述
3.2 HGD 8086 IP軟核的系統(tǒng)級設(shè)計
3.2.1 外特性
3.2.2 系統(tǒng)級設(shè)計
3.3 指令系統(tǒng)
3.3.1 指令格式和指令編碼
3.3.2 尋址方式
3.3.3 指令集
3.4 總線接口時序
3.4.1 兼容的總線接口時序
3.4.2 改進(jìn)的總線接口時序
3.5 RTL級設(shè)計
3.5.1 設(shè)計樹狀圖
3.5.2 配置文件CONFIG
3.5.3 數(shù)據(jù)通路
3.5.4 控制通路
3.6 本章小結(jié)
第四章 HGD 8086 IP軟核的仿真與驗證
4.1 概述
4.2 驗證平臺的搭建
4.3 HGD 8086 IP的仿真與驗證
4.3.1 HGD 8086的驗證平臺
4.3.2 啟動功能測試
4.3.3 指令集測試
4.3.4 復(fù)雜功能測試
4.3.5 代碼覆蓋率
4.4 FPGA功能驗證
4.4.1 驗證環(huán)境
4.4.2 FPGA功能驗證結(jié)果
4.5 本章小結(jié)
第五章 總結(jié)與展望
5.1 總結(jié)
5.2 展望
參考文獻(xiàn)
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本文編號:3738920
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