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YHFT-Matrix DSP中DMA設(shè)計實現(xiàn)與存儲二維擴展

發(fā)布時間:2021-02-15 00:21
  當(dāng)前,高性能通用DSP逐漸向向量多核方向發(fā)展,其中存儲部件是制約其高性能執(zhí)行的重要因素。本文以無線通信、視頻、圖像處理等實時應(yīng)用為背景,以國防科技大學(xué)自主研制的高性能通用DSP YHFT-Matrix為依托,從以下幾個方面對向量存儲系統(tǒng)進(jìn)行了研究和設(shè)計。首先,為滿足DSP片內(nèi)存儲數(shù)據(jù)搬移的需求,本文深入分析了該芯片的體系結(jié)構(gòu)與存儲結(jié)構(gòu),根據(jù)應(yīng)用特點,設(shè)計了一款靈活支持矩陣搬移的多通道多總線DMA控制器。其次,在圖像、視頻應(yīng)用中廣泛存在滑窗類算法,傳統(tǒng)的一維存儲以及DMA機制在向量DSP中映射時,存在數(shù)據(jù)組織困難、數(shù)據(jù)重用率低等問題。本文提出了一種存儲二維化改進(jìn)方案,在原有的一維存儲系統(tǒng)基礎(chǔ)上,擴展了一塊容量為256KB 1D/2D可配置的二維存儲模塊,并設(shè)計了相應(yīng)的訪存指令。最后,為了配合存儲二維擴展方案,本文通過增加具有二維訪問功能的DMA專用通道,支持二維存儲與片外存儲之間的數(shù)據(jù)傳輸;并在一維存儲與二維存儲之間增加512位位寬的Intra-DMA,從而充分發(fā)揮1D、2D存儲器的整體性能,提高存儲系統(tǒng)利用率。本文對DMA控制器、二維存儲器進(jìn)行了充分的模擬驗證,針對YHFT-Matri... 

【文章來源】:國防科技大學(xué)湖南省 211工程院校 985工程院校

【文章頁數(shù)】:80 頁

【學(xué)位級別】:碩士

【部分圖文】:

YHFT-Matrix DSP中DMA設(shè)計實現(xiàn)與存儲二維擴展


AnySPPE的整體結(jié)構(gòu)

整體結(jié)構(gòu),處理器


國防科學(xué)技術(shù)大學(xué)研究生院工學(xué)碩士學(xué)位論文率較高的指令,加速了算法的執(zhí)行。通過寄存器分離和旁路技術(shù)減小了寄件的壓力,降低了功耗。該小組對 4G 通信以及視頻圖像處理的核心算法進(jìn)射,能夠在功效方面達(dá)到 4G 通信算法和高清解碼的要求。盡管 AnySP 還整的芯片實現(xiàn),但在學(xué)術(shù)界對未來 DSP 體系結(jié)構(gòu)探索方面具有重要的影響。2、EVPEVP[21][22]是Phillips公司的一款面向基帶處理且比較成熟的多寬度SIMDP,該處理器結(jié)合了多寬度 SIMD 技術(shù)和超長指令字的優(yōu)點,采用 90nm CM藝,面積約為 2mm2,工作頻率為 300MHz,典型的存儲配置下功耗只有 300m如圖 1-2 所示,EVP 由一個多路向量單元(16 個 16bits)和一個標(biāo)量單元組量單元包含 load/Store、乘加、ALU、混洗、向量間運算等六個運算部件,洗單元提供了可編程的混洗模式寄存器,支持循環(huán)、移位、廣播等任意形洗,向量間運算部件主要提供向量元素間的加法規(guī)約、極值操作等功能。元行為類似與 16/32bit 的 RISC CPU 核,主要負(fù)責(zé)處理一些不能并行計rnel 和控制操作等。

整體結(jié)構(gòu)


國防科學(xué)技術(shù)大學(xué)研究生院工學(xué)碩士學(xué)位論文Sandblaster 平臺由四個 Sandblaster DSP 通過環(huán)型網(wǎng)絡(luò)互聯(lián),一個 ARM9協(xié)議棧的執(zhí)行,每一個 Sandblaster DSP 包含一個 SIMD/DSP 單元、一個單元和一個 RISC 結(jié)構(gòu)的整數(shù)控制單元,如圖所示。整數(shù)控制單元從一個指令 Cache 中預(yù)取指令,采用類 VLIW 的方式執(zhí)行指令。指令 Cache 的了程序員將程序搬移到 SRAM 的負(fù)擔(dān)。由于大多數(shù)基站通信系統(tǒng)的數(shù)據(jù)模式,所以數(shù)據(jù) memory 沒有采用 Cache 結(jié)構(gòu)。數(shù)據(jù) Memory 支持 8 個線問,存儲空間是統(tǒng)一的,允許操作系統(tǒng)訪問每一個線程的數(shù)據(jù)。程序 據(jù) Memory 均為 64KB,采用單端口設(shè)計以減少功耗,采用分體結(jié)構(gòu)來提給能力。

【參考文獻(xiàn)】:
期刊論文
[1]軟件無線電的可重構(gòu)流處理器體系結(jié)構(gòu)[J]. 高德遠(yuǎn),田杭沛,朱怡安.  航空學(xué)報. 2008(06)

博士論文
[1]視頻和圖像處理中像素匹配運算的加速技術(shù)研究[D]. 谷會濤.國防科學(xué)技術(shù)大學(xué) 2011



本文編號:3034095

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