隨著集成電路的快速發(fā)展，SoC已成為超大規(guī)模集成電路的發(fā)展趨勢和新世紀集成電路的主流。SoC的設計實現(xiàn)基于其電路高復雜性、縮短開發(fā)周期以及降低成本的要求，其設計必須采用基于IP復用的設計方法。IP核的開發(fā)是SoC這種設計方法的關鍵和基礎。本文完成了80196十六位單片機IP的研究、設計和驗證。 本文主要以現(xiàn)在廣為使用、功能強大的80196單片機為模型介紹可復用IP核的設計基本方法和流程。設計使用Verilog語言，對設計的十六位單片機IP進行綜合、布局布線、功能仿真和時序仿真后，進行FPGA實現(xiàn)。最后使用ChipScope軟件工具進行FPGA驗證。本文給出了像單片機這樣的CPU類型IP的結(jié)構劃分、仿真、FPGA驗證等開發(fā)流程各步驟的實現(xiàn)方法。本文完成十六位單片機IP的開發(fā)并且驗證了其功能的正確性，所開發(fā)的IP核與80196單片機在指令系統(tǒng)和外設方面完全兼容，這對以后開發(fā)IP和IP庫的建設以及今后進行SoC開發(fā)都有很大意義。 

【文章來源】：中國工程物理研究院北京市

【文章頁數(shù)】：79 頁

【學位級別】：碩士

【部分圖文】：

IP綜合后的第二層RTL圖

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【參考文獻】：
期刊論文
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博士論文
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本文編號：2980841