32位DSP高性能串行接口的設(shè)計與實現(xiàn)
【學(xué)位單位】:國防科學(xué)技術(shù)大學(xué)
【學(xué)位級別】:碩士
【學(xué)位年份】:2010
【中圖分類】:TP368.12
【文章目錄】:
摘要
ABSTRACT
第一章 緒論
1.1 課題研究的背景及意義
1.2 業(yè)界串行通信
1.2.1 串口通信及發(fā)展現(xiàn)狀
1.2.2 與高性能串口接口的串行設(shè)備
1.3 文章組織結(jié)構(gòu)
1.4 本章小結(jié)
第二章 總體結(jié)構(gòu)設(shè)計概述
2.1 設(shè)計需求分析
2.1.1 外部接口分析
2.1.2 內(nèi)部接口DMA
2.2 功能模塊劃分
2.3 接口設(shè)計與定義
2.4 本章小結(jié)
第三章 串口功能模塊設(shè)計
3.1 時鐘幀同步產(chǎn)生模塊
3.1.1 采樣率發(fā)生器的設(shè)計
3.1.2 時鐘幀同步產(chǎn)生
3.2 地址譯碼和讀寄存器模塊
3.3 發(fā)送模塊
3.3.1 數(shù)據(jù)通路設(shè)計
3.3.2 控制通路設(shè)計
3.4 接收模塊
3.4.1 數(shù)據(jù)通路設(shè)計
3.4.2 控制通路設(shè)計
3.5 對數(shù)壓縮解壓及符號擴展模塊
3.5.1 對數(shù)壓縮解壓
3.5.2 符號擴展功能
3.6 中斷同步事件的產(chǎn)生
3.7 SPI協(xié)議的實現(xiàn)
3.8 多通道控制邏輯設(shè)計
3.9 異步信號的處理
3.9.1 慢時鐘域下的控制信號進入快時鐘域
3.9.2 快時鐘域下的控制信號進入慢時鐘域
3.9.3 總線信號的同步
3.10 本章小結(jié)
第四章 功能驗證
4.1 驗證計劃
4.2 驗證平臺的搭建
4.2.1 測試系統(tǒng)結(jié)構(gòu)
4.2.2 測試代碼結(jié)構(gòu)
4.2.3 功能驗證和時序驗證
4.3 驗證的自動化
4.4 驗證過程及質(zhì)量
4.5 本章小結(jié)
第五章 邏輯綜合與后仿接口參數(shù)調(diào)整
5.1 綜合策略與結(jié)果分析
5.1.1 綜合方法與策略
5.1.2 結(jié)果分析及優(yōu)化
5.2 接口參數(shù)調(diào)整
5.3 本章小結(jié)
第六章 結(jié)束語
致謝
參考文獻
作者在學(xué)期間取得的學(xué)術(shù)成果
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本文編號:2836278
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