龍芯多核平臺上性能分析工具的設計與實現(xiàn)
【學位授予單位】:中國科學技術大學
【學位級別】:碩士
【學位授予年份】:2011
【分類號】:TP332
【圖文】:
這些障礙阻止了通過提高主頻來獲得性能提升的道路;其次,單個芯片可以集成的引腳數(shù)目和帶寬限制都意味著處理器和主存之間的速度的剪刀差在越拉越大。2006 年,Intel 被迫放棄了 4G 主頻的 Tejas 奔騰 4 處理器的開發(fā),這幾乎也標志著主頻至上的理論走到了盡頭,取而代之的是片上多核設計。
靜態(tài)插樁這種類型的插樁是在源代碼編譯或鏈接時完成的,它的唯一優(yōu)勢是我們復雜的功能并且對程序性能影響很小。但是,靜態(tài)插樁卻有很多限制,最一個限制是,如何執(zhí)行程序中的代碼和數(shù)據(jù)是混合放置的,靜態(tài)插樁工具取足夠的信息來分開它們;靜態(tài)插樁工具也很難處理間接分支、共享庫以產(chǎn)生的代碼。靜態(tài)插樁的最經(jīng)典的工具便是 Gcc 自帶的 Gprof(FSF,1998 動態(tài)插樁與靜態(tài)插樁相反,動態(tài)插樁在程序運行時實現(xiàn)。它克服了靜態(tài)插樁所有。動態(tài)插樁不需要重新編譯或鏈接程序,能夠處理運行中的程序以及共享為程序優(yōu)化提供了更多機會。動態(tài)插樁方面的代表性的工作包括 ATI(Srivastava,1994)、Dtrace(Cantrill,2004)、Pin(Luk, 2005)等。.2 采樣技術 基于時間的采樣
) 基于事件的采樣性能計數(shù)器(HPCs)越來越多的用于分析性能以及確定性能瓶頸的原因。大現(xiàn)代處理器中都帶有一定數(shù)量的性能計數(shù)器。例如:IBM POWER4 有 8 對計數(shù)器、Intel Itanium 4 個、AMDAthlon 有 4 個。這些性能計數(shù)器的功能就錄硬件事件,通過性能調(diào)優(yōu)工具的處理之后,產(chǎn)生對程序員有用的信息。基于事件的采樣是只記錄特定的硬件事件(比如 L2 Cache Miss)的發(fā)生,當達到用戶設定的閾值時就記錄一下(采一個樣)。具體的工作方式是:選擇需要記錄的硬件事件(例如:L2 Cache Miss),該事件每發(fā)生一次就觸發(fā)計數(shù)器加 1,當性能計數(shù)器的值達到設置的閾值時,就向上溢出,觸發(fā)處理內(nèi)部中斷控制器,中斷處理器進行采樣,如圖 1.3 所示是基于事件的采樣的:
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本文編號:2785107
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