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高效能嵌入式處理器IP核

發(fā)布時間:2020-06-28 10:40
【摘要】:為了提升嵌入式處理器的性能,本文基于浙大數(shù)芯實驗室的32位嵌入式處理器RISC32E,分析其性能和頻率瓶頸,提出流水線深化的Gemini結(jié)構(gòu)框架,并在Gemini處理器上進行存儲系統(tǒng)的改進,采用數(shù)據(jù)預(yù)取機制提升了Gemini處理器的訪存性能。同時,針對嵌入式處理器的低功耗需求,采用處理器的功耗模型進行了Gemini的功耗評估方法的探索。 本文首先以單發(fā)射處理器的訪存操作為導(dǎo)向劃分Gemini的流水線。實驗結(jié)果表明,Gemini處理器在TSMC130nm標(biāo)準(zhǔn)單元工藝下,worst case主頻為360MHz, typical case主頻為500MHz, EEMBC的評分在ConsumerMark為0.11/MHz,相比RISC32E處理器的0.084/MHz提高了31.9%;TeleMark為0.02/MHz,相比RISC32E的0.0119/MHz提高了66.6%。 Gemini處理器中采用硬件數(shù)據(jù)預(yù)取的方式來提高處理器的訪存性能。采用一種基于流緩沖的可變步長的最小差值預(yù)取,通過記錄每次發(fā)生Cache缺失地址,計算最小差值并當(dāng)最小差值匹配時進行數(shù)據(jù)的預(yù)取,將預(yù)取數(shù)據(jù)取入數(shù)據(jù)Cache中。Dhrystone的評測結(jié)果表明Gemini處理器中的硬件數(shù)據(jù)預(yù)取機制可提升性能2.1%。EEMBC的評分在ConsumerMark評測下通過硬件數(shù)據(jù)預(yù)取性能有3.3%的提升,在TeleMark的評測下性能有3.7%的提升。 本文最后對比分析不同層次的處理器功耗模型,如在系統(tǒng)級的功耗模型,在RTL門級的功耗模型,在晶體管電路級的功耗模型等。并基于RTL級的功耗模型對Gemini處理器進行了功耗評估。
【學(xué)位授予單位】:浙江大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2011
【分類號】:TP332
【圖文】:

流水線,流水,譯碼


ITLB:Ins汀uet一 on11B PCUPIPellneeon汀 01unlr圖2一 2Rlse32E六級流水線 IF(InstruetionFetch)流水級:租SC32E使用指令虛地址索引指令Caehe,指令物理地址通過訪問指令TLB得到。為加快指令執(zhí)行,指令TLB和指令cache的訪問是同時進行的。同時,IF級需要進行指令cache標(biāo)志和TLB的比較,實現(xiàn)四路組關(guān)聯(lián)Cache的路選擇,讀入新的指令到流水線IF/ID界面寄存器中。 ID(InstruetionDecode)流水級:該級對寄存在IF/ID界面寄存器中的指令進行譯碼,給出指令譯碼信號,根據(jù)譯碼結(jié)果訪問寄存器文件?刂妻D(zhuǎn)移類指令在ID級解析轉(zhuǎn)移地址。另外從完成時間角度來說,數(shù)據(jù)旁路單元(BPu)也在ID級完成數(shù)據(jù)旁路。EX(Execution)流水級:所有指令的運算操作在Ex級完成。如運算類指令計算結(jié)果

框圖,處理器,系統(tǒng)結(jié)構(gòu),框圖


浙淚_大學(xué)石頁士學(xué)位論文Gemini處理器的微結(jié)構(gòu)處理器核Gemini的系統(tǒng)結(jié)構(gòu)框架如圖2一4所示[l7J。圖2一4中虛線表示處理器核,包括流水線、32K字節(jié)的指令Cache、 16K字節(jié)的數(shù)據(jù)Caehe、以及 32x32的通用寄存器文件等。微結(jié)構(gòu)采用9級流水線的設(shè)計,包括存儲管理系統(tǒng)(Memory ManagementUnit,MMU)和協(xié)處理器(co一proeessor),采用AMBA作為片上總線。 AdvaneedHighperformanceBus(AHB)系統(tǒng)總線上的主設(shè)備包括處理器核和usB主設(shè)備接口,從設(shè)備包括sDRAM控制器和sRAM控制器, AdvancedperipheralBus(APB)總線上設(shè)備包括sPI、125、uA盯、Tsmer和xZe接口等。處理器核包括EJ認(rèn)G調(diào)試接口,通過EJTAG接口和宿主機(Host)相連

【參考文獻】

相關(guān)期刊論文 前1條

1 肖志斌;劉鵬;姚英彪;姚慶棟;;Optimizing pipeline for a RISC processor with multimedia extension ISA[J];Journal of Zhejiang University Science A(Science in Engineering);2006年02期

相關(guān)碩士學(xué)位論文 前1條

1 江國范;異質(zhì)媒體雙發(fā)射處理器的設(shè)計研究[D];浙江大學(xué);2008年



本文編號:2732910

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