【摘要】： 本課題參與研制的X型DSP是一款高性能、低功耗的16位定點數(shù)字信號處理器芯片。它采用改進的哈佛結構(一條程序存儲器總線、3條數(shù)據(jù)存儲器總線和4條地址總線),CPU內(nèi)核整合了算術邏輯運算單元ALU、乘累加單元MAC、比較＼選擇＼存儲單元CSSU、指數(shù)編碼器EXP等功能部件,片上集成大量的存儲器和豐富的外設,采用高度專業(yè)化的指令集,這都使得X型DSP特別適合于嵌入式應用。 本課題采用0.18μmCMOS工藝,采用全定制的方法,設計并實現(xiàn)了X型DSP的程序尋址部件,并對其進行了全面的系統(tǒng)級驗證和分析。本課題研究的主要內(nèi)容和成果包括以下幾個方面： 1、本文在深入研究了X型DSP指令集和體系結構的基礎上,并根據(jù)X型DSP處理器的總體設計要求,確定了程序尋址部件的總體結構。 2、采用自頂向下、逐級細化的方法對程序尋址部件進行模塊劃分,并采用全定制的方法對各模塊進行了設計。其中對關鍵模塊還進行了電路級優(yōu)化和性能分析,并對各種程序尋址操作的實現(xiàn)原理也做了詳細分析。 3、在模塊級驗證全部通過的基礎上,對X型DSP的程序尋址部件進行了全芯片系統(tǒng)級的功能驗證,驗證結果表明該部件的設計完全滿足X型DSP的設計要求。 X型DSP處理器已經(jīng)投片成功,完全滿足了設計要求,也證明了作為其重要控制部件——程序尋址部件的正確性。
【圖文】：

國防科學技術大學研究生院工程碩士學位論文第二章X型DSP體系結構概述互2.IX型DSP的組成X型DSP是一款基于高級的改進型Harvard體系結構的16bit定點DSP。片共有8條總線(l條程序存儲器總線，3條數(shù)據(jù)存儲器總線以及4條對應的地址線)，以達到最大的處理能力。芯片整合了帶有高度并行運算單元的CPU內(nèi)核專用硬件邏輯、片上存儲器和在片外圍電路，再加上高度專業(yè)化的指令集和模化的結構設計，使芯片低功耗、高并行度、操作靈活、對高級系統(tǒng)的支持友好應用領域廣泛等優(yōu)點十分突出。X型DSP總體結構如圖2.1所示，主要由以下能部件組成:CPU內(nèi)核、片內(nèi)存儲器、片內(nèi)外設、總線等。[vl}p，e，，n，EBuse:^ndeontrolsi，己:}

圖3.7PC+1邏輯偶數(shù)位圖3.8PC十l邏輯的功能驗證.2程序地址緩沖寄存器要的基本的觀察來源于程序的特征，我們經(jīng)常用到的最重要的程序原理:程序經(jīng)常會重復使用它最近使用過的指令和數(shù)據(jù)。一個廣泛理是，程序花費90%的執(zhí)行時間來執(zhí)行10%的代碼。局部性原理意利用最近使用過的指令和數(shù)據(jù)在一定誤差范圍內(nèi)合理地預測將要用據(jù)。局部性原理也可以應用于數(shù)據(jù)存取，盡管不像在指令存取中效[12][13]兩種類型的局部性原理。時間局部性原理說明最近訪問過的內(nèi)容很
【學位授予單位】：國防科學技術大學
【學位級別】：碩士
【學位授予年份】：2009
【分類號】：TP368.1

【共引文獻】

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本文編號：2705999