MCU模塊的自動化功能測試系統(tǒng)的實現(xiàn)
【圖文】:
7有 Memory Window,HTMI output 窗口。Data Log 中顯示具體的操作過程和結(jié)果信息。Flow List 列出 Test Flow 的組成項,例如圖 2.2 中有三個 Flow List item。TestFlow 是整個測試流程中的項,如 download、excute,這些不同項都分別表明流程控制中都有些什么樣的操作指令,都要做什么。圖 2.2 JAZZ 環(huán)境圖 2.3 是打開 JAZZ 界面后首先進行的初始化配置。由上圖可以看出,JAZZ環(huán)境適用于很多不同的器件,無論是外部振蕩器,還是頻率、溫度都是可以調(diào)節(jié)的,所以方便了不同崗位的工程師進行不同要求的測試,確認在不同的外界環(huán)境下產(chǎn)品的功能是否正常、指標是否滿足。JAZZ 自動化控制系統(tǒng)是整個測試系統(tǒng)中的流程控制指令發(fā)起者。由于篇幅原因,本論文不對 JAZZ 的控制原理進行詳細討論
圖 2.3 Jazz.ini 界面2.3 FPGA 實現(xiàn)2.3.1 選用 FPGA 實現(xiàn)本設(shè)計的原因本系統(tǒng)中的引腳互聯(lián)部分、命令通道接口部分是由 FPGA 實現(xiàn)的。接下來就為什么選用 FPGA 而不通過增加 MCU 外設(shè)來實現(xiàn)的原因進行分析和說明。首先,什么是 FPGA 呢?現(xiàn)場可編程門陣列(FPGA)是由可配置(可編程)邏輯塊組成的數(shù)字集成電路[5]。這些邏輯塊之間用可配置的互聯(lián)資源。相對于FPGA 的是專用集成電路(ASIC)。盡管 ASIC 在尺寸,晶體管的數(shù)量,復(fù)雜性和性能實現(xiàn)上都是最佳的,但是設(shè)計和制造它是一個很耗費時間和代價昂貴的過程,還有一個不足,就是最終的設(shè)計是固定的,不開發(fā)新的版本,就無法調(diào)整。FPGA設(shè)計的成本要大大低于 ASIC 設(shè)計的成本,盡管大規(guī)模生產(chǎn)時 ASIC 部件肯定要比 FPGA 便宜的多,但是,在 FPGA 中對設(shè)計修改要容易得多,而且這種設(shè)計的
【學(xué)位授予單位】:西安電子科技大學(xué)
【學(xué)位級別】:碩士
【學(xué)位授予年份】:2009
【分類號】:TP368.11
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,本文編號:2636356
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