【摘要】： 流體系結(jié)構(gòu)是近年來新興的一種高性能體系結(jié)構(gòu)。FT64作為國內(nèi)第一款自主研究設(shè)計的64位流處理器,其核心級采用了SIMD+VLIW的執(zhí)行模式,開發(fā)程序中的并行性,其運算簇內(nèi)采用分布式寄存器文件結(jié)構(gòu),支持大規(guī)模功能單元陣列對寄存器容量及速度的需要。VLIW技術(shù)有利于芯片提升頻率、降低功耗,同時也對編譯器提出了很高的要求,而當應(yīng)用領(lǐng)域擴展后,應(yīng)用對寄存器需求的急劇增大使得分布式寄存器文件中單寄存器文件的容量成為了應(yīng)用編程和編譯中的一個瓶頸。 本文研究了流處理器中的VLIW編譯技術(shù),目的是為FT64提供高效的VLIW編譯器,為用戶程序的高效執(zhí)行提供編譯支持。 在目前已有研究的基礎(chǔ)上,本文基于ISCD源代碼、應(yīng)用背景和工程實踐需要,針對FT64流處理器設(shè)計實現(xiàn)了其核心級編譯器。在研究了相關(guān)背景后,編譯器的實現(xiàn)主要集中于策略的選擇、工程實現(xiàn)及對瓶頸部分的處理上。通信調(diào)度保證了VLIW調(diào)度在針對FT64核心級的共享互連結(jié)構(gòu)時的高效;采用load schedule策略在不降低程序性能的情況下使得寄存器分配成功,避免了因為寄存器過載而造成的性能損失;針對程序中的特征采用乘加操作自動合并算法提高編譯效率。 本文實現(xiàn)的編譯器目前已經(jīng)在FT64流處理器的系統(tǒng)運行中投入實際使用,并取得了很好的效果。本文還在FT64上對編譯器的各項性能進行了實測和性能分析,實現(xiàn)結(jié)果表明,在采取了多種優(yōu)化措施后,編譯器能夠很好的識別出程序中的并行性,取得了預(yù)期的效果。
【圖文】：

因而主要采用分布式寄存器文件，以共享互連總線的方式連接。傳統(tǒng)的通用處理器體系結(jié)構(gòu)如圖1.11’。]所示，研究表明它們并不適合于計算密集型應(yīng)用，因為它們難以支撐足夠多的功能單元來滿足密集計算程序的計算需求。通過圖1.1可以看出，每個功能單元的輸入輸出都通過一個獨占的總線連接到一個集中的寄存器文件上，這個寄存器文件要為每個連接到其上的總線提供一個端口。研究表明在這種結(jié)構(gòu)中，第2頁

1~3個局部寄存器文件(L盯)，局部寄存器文件的讀端口直接與對應(yīng)功能單元的輸入端口連接，每個功能單元只能從自己的局部寄存器文件中讀取操作數(shù)。所有寄存器文件的寫端口同所有功能單元的輸出端口之間通過圖1.2所示的共享互連連接，使得數(shù)據(jù)可以在不同寄存器文件間通信傳輸。共享互連交叉開關(guān)保證了每個功能單元的輸出端口通過一個交叉點可以無阻塞得與一個空閑寄存器文件寫端口相連，所有的寄存器文件和功能單元間可以同時傳輸數(shù)據(jù)，因此擁有很高的帶寬。而且在這種結(jié)構(gòu)下所有寄存器文件(包括交叉開關(guān))面積之和改進到。((N/c)’)的量級，，其中N是功能單元的數(shù)目，c是一個常數(shù)，延遲和功耗也有相同的關(guān)系。由于帶寬優(yōu)勢，以及硬件開銷較小，絕大多數(shù)新一代計算密集型處理器在擴展到大規(guī)模ALU時都采用了分布式寄存器文件結(jié)構(gòu)。Imagine流處理器的流片結(jié)果表明
【學(xué)位授予單位】：國防科學(xué)技術(shù)大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2007
【分類號】：TP332

【共引文獻】

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7 劉e

本文編號：2617783