【摘要】： 在光盤系統(tǒng)中,通道編碼方法對于通道性能有很大的影響,是光盤標準制訂過程中需要重點考慮的因素之一,也是光盤標準中知識產權關注的要點,因此一直都是國內外研究的焦點。游程長度受限(Run-Length Limited,RLL)碼是一種在光盤中廣泛應用的調制編碼,針對新一代紅光高清光盤標準需要解決的關鍵技術,對具有自主知識產權的RLL(1,10;4,6)調制碼進行了研究。 在分析調制編碼技術和RLL碼在光盤標準中的功能、應用和發(fā)展趨勢的基礎上,指出調制方式是大容量光盤領域發(fā)展的重要制約因素之一,同時對RLL碼的參數(shù)作了簡要分析。 RLL碼有多種構造方式,包括固定長度分組碼、可變長度分組碼、狀態(tài)依賴固定長度分組碼、可變長度固定碼率碼和前視碼,對各種編碼類型的特點進行了分析和討論;在此基礎上,給出了RLL(1,10;4,6)前視碼的構造方法,設計了該碼的基本碼表和替換碼表;介紹了RLL(1,10;4,6)碼調制和解調的步驟和方法,針對通道特性分析了碼的性能,研究了直流分量的控制方法。在特定游程長度條件下,分析設計了同步碼。 通過軟件仿真對RLL(1,10;4,6)碼的性能進行了分析,采用FPGA在芯片級實現(xiàn)了解調算法。介紹了仿真軟件的設計思想和原理,重點介紹了如何用滑動窗口對信源碼字進行調制,以及如何動態(tài)計算直流分量,從而選擇直流分量絕對值較小的調制序列。在Quartus II環(huán)境下對硬件實現(xiàn)的解調算法進行了仿真。 分析測試表明,具有自主知識產權的RLL(1,10;4,6)通道調制碼可以滿足新一代紅光高清光盤的要求,而且基于FPGA實現(xiàn)的處理算法功能正確、處理速度快、性能可靠。
【圖文】：

仿真環(huán)境uartus II 可編程邏輯開發(fā)軟件為芯片級的設計提供了一個非常完善的支持原理圖輸入、模塊化設計、AHDL、VHDL 和 Verilog HDL，功能合，功能和時序仿真，自動錯誤定位以及器件的下載和驗證。erilog HDL 語言是一種應用最為廣泛的硬件描述語言，可用來進行各種計，，也可以進行仿真驗證、時序分析等。Verilog HDL 語言適合orithm Level）、寄存器傳輸級（RTL，Register Transfer Level）、門級（Gate級（Layout Level）等各個層次的設計和描述[40]。PGA 芯片采用 Altera 公司 Stratix 系列的 EP1S40F780C5，總共擁有 413,423,744bits 的 RAM、6 個 DSP 功能模塊、48 個嵌入式乘法器、12 個達 822 個 I/O 接口，功能十分強大，能夠滿足解調器實現(xiàn)的需求。譯后的統(tǒng)計報告（見圖 5.5）所示，邏輯宏單元 LCs 用了 481 個（5%） 資源用了 33，152 個片內 ROM 位（1%），即 4144 個 8 位數(shù)據(jù)單元。

25ns 時的仿真結果波形如圖 5.8 所示，從圖中可看出當數(shù)據(jù)有效的觸發(fā)信號變?yōu)楦唠娖綍r，訪問 ROM 的地址信號 add 開始變化，即觸發(fā)信號有效時解調控制器才從 ROM 中讀取數(shù)據(jù)，與設計流程一致。
【學位授予單位】：華中科技大學
【學位級別】：碩士
【學位授予年份】：2007
【分類號】：TP333.4

【參考文獻】

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2 胡華;徐端頤;胡恒;;光存儲系統(tǒng)中的游程長度受限編碼[J];光學技術;2006年03期

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本文編號：2617130