基于SCA規(guī)范的PCI設(shè)備驅(qū)動(dòng)設(shè)計(jì)與實(shí)現(xiàn)
發(fā)布時(shí)間:2020-04-06 15:17
【摘要】: 為了克服傳統(tǒng)通信系統(tǒng)成本高昂、功能單一、維護(hù)升級(jí)困難等缺點(diǎn),軟件通信體系結(jié)構(gòu)(SCA)采用標(biāo)準(zhǔn)化的軟件構(gòu)件思想,有效提高了無線通信系統(tǒng)的軟件復(fù)用程度,節(jié)省了設(shè)計(jì)開發(fā)成本,縮短了新技術(shù)驗(yàn)證和實(shí)現(xiàn)周期。另一方面PCI總線由于其標(biāo)準(zhǔn)化、模塊化、即插即用等特點(diǎn),目前被諸多SCA設(shè)備廠商廣泛使用。根據(jù)項(xiàng)目總體設(shè)計(jì)需求,本文對(duì)SCA規(guī)范下的PCI設(shè)備驅(qū)動(dòng)進(jìn)行了深入分析與研究,為應(yīng)用層的波形開發(fā)提供了統(tǒng)一的、開放的底層支撐和服務(wù)。 首先,論文對(duì)SCA規(guī)范從軟硬件兩方面進(jìn)行了研究,闡述了其硬件管理特點(diǎn)以及軟件結(jié)構(gòu)層次,針對(duì)項(xiàng)目組開發(fā)的基于SCA規(guī)范的嵌入式平臺(tái),分析了在該平臺(tái)上的SCA體系接口實(shí)現(xiàn)方法,重點(diǎn)解決了該平臺(tái)中的非CORBA組件在SCA中的設(shè)備接口,明確了PCI設(shè)備驅(qū)動(dòng)在SCA嵌入式平臺(tái)中的功能。 其次,通過對(duì)PCI總線結(jié)構(gòu)和通信方法的深入研究,并根據(jù)系統(tǒng)需求,設(shè)計(jì)實(shí)現(xiàn)了基于PCI的FPGA從板的算法程序的動(dòng)態(tài)加載以及主控板波形應(yīng)用組件與FPGA板非CORBA組件的通信。該設(shè)計(jì)方案為各模塊間通信提供底層功能函數(shù)接口服務(wù),并將接口封裝于SCA核心框架的非CORBA組件設(shè)備接口中,完成了上層波形組件對(duì)下層硬件設(shè)備的屏蔽。 最后論文設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)在SCA規(guī)范下完成PCI設(shè)備驅(qū)動(dòng)動(dòng)態(tài)加載的演示系統(tǒng),并介紹了在實(shí)際的項(xiàng)目調(diào)試中所遇到的問題和解決辦法。
【圖文】:
圖 2.5 無線電信號(hào)處理系統(tǒng)硬件結(jié)構(gòu)該 PCI 總線結(jié)構(gòu)依據(jù) PCI 規(guī)范,體現(xiàn)了三種 PCI 設(shè)備實(shí)現(xiàn)方案:1) 采用專用的 PCI 芯片:如 MPC8260 主控板中的 PCI9054 芯片,設(shè)計(jì)者只須使用地址線、數(shù)據(jù)線以及少數(shù)個(gè)讀寫控制信號(hào),實(shí)現(xiàn) PCI 總線與 PCI 用戶設(shè)備之間的連接。PCI9054 是一種 32 位/33MHz 的通用 PCI 總線控制器專用芯片,符合 PCI 本地總線范 2.2 版,突發(fā)傳輸速率達(dá)到 132MB/s,本地總線支持復(fù)用/非復(fù)用的 32 位地址/數(shù)據(jù),為一種模式:M 模式、C 模式、J 模式。具有可選的串行 E2PROM 接口,本地總線時(shí)鐘和 PCI 時(shí)鐘異步。PCI9054 內(nèi)部有六種可編程的 FIFO,以實(shí)現(xiàn)零等待突發(fā)傳輸及本地總和 PCI 總線之間的異步操作。PCI9054 支持主模式、從模式、DMA 傳輸方式,因其強(qiáng)的功能可應(yīng)用于適配卡和嵌入式系統(tǒng)中。用戶通過設(shè)置其內(nèi)部寄存器,即可完成各種控功能。PCI 9054 內(nèi)部寄存器的配置信息可以寫在一片串行 E2PROM 中,在加電時(shí) PCI 90自動(dòng)加載串行 E2PROM 配置信息,并由 PCI BIOS 通過 PCI 總線對(duì)配置寄存器讀寫。P9054 可方便地與各種存儲(chǔ)設(shè)備相連接,在本設(shè)計(jì)中,它與 FIFO 及 E2PROM 的設(shè)計(jì)接口圖 2.6 所示[14]。
國(guó)防科學(xué)技術(shù)大學(xué)研究生院學(xué)位論文2.3.2 PCI 通信信號(hào)依據(jù) PCI 規(guī)范,如圖 2.7 所示,分別說明了 PCI 傳輸中必備和可選的 PCI 接口信號(hào)。按照功能可分為地址和數(shù)據(jù)信號(hào)、接口控制信號(hào)、錯(cuò)誤報(bào)告信號(hào)、仲裁信號(hào)、系統(tǒng)信號(hào)、64 位總線擴(kuò)展信號(hào)、JTAG 信號(hào)、中斷信號(hào)等等。數(shù)據(jù)線和地址線采用多路復(fù)用結(jié)構(gòu),,減少了引腳數(shù)。一般,目標(biāo)設(shè)備可以只用 47 條引腳,而總線主控可以只用 49 條引腳;利用這些信號(hào)可以處理數(shù)據(jù)、地址,實(shí)現(xiàn)接口控制、仲裁及系統(tǒng)功能。
【學(xué)位授予單位】:國(guó)防科學(xué)技術(shù)大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2006
【分類號(hào)】:TP368.1
本文編號(hào):2616682
【圖文】:
圖 2.5 無線電信號(hào)處理系統(tǒng)硬件結(jié)構(gòu)該 PCI 總線結(jié)構(gòu)依據(jù) PCI 規(guī)范,體現(xiàn)了三種 PCI 設(shè)備實(shí)現(xiàn)方案:1) 采用專用的 PCI 芯片:如 MPC8260 主控板中的 PCI9054 芯片,設(shè)計(jì)者只須使用地址線、數(shù)據(jù)線以及少數(shù)個(gè)讀寫控制信號(hào),實(shí)現(xiàn) PCI 總線與 PCI 用戶設(shè)備之間的連接。PCI9054 是一種 32 位/33MHz 的通用 PCI 總線控制器專用芯片,符合 PCI 本地總線范 2.2 版,突發(fā)傳輸速率達(dá)到 132MB/s,本地總線支持復(fù)用/非復(fù)用的 32 位地址/數(shù)據(jù),為一種模式:M 模式、C 模式、J 模式。具有可選的串行 E2PROM 接口,本地總線時(shí)鐘和 PCI 時(shí)鐘異步。PCI9054 內(nèi)部有六種可編程的 FIFO,以實(shí)現(xiàn)零等待突發(fā)傳輸及本地總和 PCI 總線之間的異步操作。PCI9054 支持主模式、從模式、DMA 傳輸方式,因其強(qiáng)的功能可應(yīng)用于適配卡和嵌入式系統(tǒng)中。用戶通過設(shè)置其內(nèi)部寄存器,即可完成各種控功能。PCI 9054 內(nèi)部寄存器的配置信息可以寫在一片串行 E2PROM 中,在加電時(shí) PCI 90自動(dòng)加載串行 E2PROM 配置信息,并由 PCI BIOS 通過 PCI 總線對(duì)配置寄存器讀寫。P9054 可方便地與各種存儲(chǔ)設(shè)備相連接,在本設(shè)計(jì)中,它與 FIFO 及 E2PROM 的設(shè)計(jì)接口圖 2.6 所示[14]。
國(guó)防科學(xué)技術(shù)大學(xué)研究生院學(xué)位論文2.3.2 PCI 通信信號(hào)依據(jù) PCI 規(guī)范,如圖 2.7 所示,分別說明了 PCI 傳輸中必備和可選的 PCI 接口信號(hào)。按照功能可分為地址和數(shù)據(jù)信號(hào)、接口控制信號(hào)、錯(cuò)誤報(bào)告信號(hào)、仲裁信號(hào)、系統(tǒng)信號(hào)、64 位總線擴(kuò)展信號(hào)、JTAG 信號(hào)、中斷信號(hào)等等。數(shù)據(jù)線和地址線采用多路復(fù)用結(jié)構(gòu),,減少了引腳數(shù)。一般,目標(biāo)設(shè)備可以只用 47 條引腳,而總線主控可以只用 49 條引腳;利用這些信號(hào)可以處理數(shù)據(jù)、地址,實(shí)現(xiàn)接口控制、仲裁及系統(tǒng)功能。
【學(xué)位授予單位】:國(guó)防科學(xué)技術(shù)大學(xué)
【學(xué)位級(jí)別】:碩士
【學(xué)位授予年份】:2006
【分類號(hào)】:TP368.1
【參考文獻(xiàn)】
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本文編號(hào):2616682
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