【摘要】：隨著多種視頻編解碼標(biāo)準(zhǔn)和視頻算法的提出,視頻處理器高效性和靈活性顯得更為重要。針對(duì)視頻陣列處理器中數(shù)據(jù)加載速率與陣列處理單元處理不匹配的問題,通過對(duì)視頻編解碼標(biāo)準(zhǔn)算法的分析,深度挖掘數(shù)據(jù)訪存冗余和傳輸?shù)奶攸c(diǎn),在可編程可重構(gòu)體系結(jié)構(gòu)下,設(shè)計(jì)了支持灌入和Cache兩種工作模式的數(shù)據(jù)加載電路,并進(jìn)行了功能仿真和FPGA驗(yàn)證。結(jié)果表明,該電路能夠滿足1080P視頻處理對(duì)數(shù)據(jù)加載的要求,采用Desgin Compiler在SMIC 0.13μm CMOS工藝標(biāo)準(zhǔn)單元庫下綜合,頻率可達(dá)197 MHz。

【參考文獻(xiàn)】

相關(guān)期刊論文 前2條

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2 黃小平;樊曉椏;張盛兵;史莉雯;;32位雙發(fā)射雙流水線結(jié)構(gòu)RISC微處理器設(shè)計(jì)[J];西北工業(yè)大學(xué)學(xué)報(bào);2011年01期

【共引文獻(xiàn)】

相關(guān)期刊論文 前8條

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相關(guān)博士學(xué)位論文 前1條

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【二級(jí)參考文獻(xiàn)】

相關(guān)期刊論文 前4條

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【相似文獻(xiàn)】

相關(guān)期刊論文 前10條

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相關(guān)碩士學(xué)位論文 前5條

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4 徐佳慶;粗粒度可重構(gòu)陣列處理器性能優(yōu)化技術(shù)研究[D];國(guó)防科學(xué)技術(shù)大學(xué);2007年

5 左艷輝;粗粒度可重構(gòu)陣列處理器編譯工具研究[D];國(guó)防科學(xué)技術(shù)大學(xué);2008年

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