【摘要】：光分組交換是全光網(wǎng)絡(luò)的重要組成部分,全光緩存器是解決光分組交換沖突的關(guān)鍵器件之一。全光緩存器能在光域?qū)π盘栠M(jìn)行存儲、轉(zhuǎn)發(fā),避免了光電相互轉(zhuǎn)換過程,有效地解決多個數(shù)據(jù)包在光交換節(jié)點(diǎn)的沖突,具有讀寫速度快、緩存深度大、緩存容量高等優(yōu)點(diǎn)。為了發(fā)展光分組交換技術(shù),提高全光緩存器的性能十分必要。 可多次讀寫全光緩存器需要合適的控制光源為其提供準(zhǔn)確的控制信號光,控制緩存器中光信號的寫入和讀出。本文基于半導(dǎo)體激光器,研制了三臺可編程直接調(diào)制光信號源,為全光緩存器提供“讀”、“寫”、“清零”的控制光,并實(shí)現(xiàn)三臺光信號源間的時鐘同步,從控制光源的角度出發(fā),提高全光緩存器的性能。 主要工作及成果如下： 1.研制三臺可編程直接調(diào)制光信號源,分別為全光緩存器中的光開關(guān)提供“讀”、“寫”、“清零”的控制光。完成電路板的焊接、調(diào)試、測試、整機(jī)的裝箱、光信號的測試等。實(shí)現(xiàn)了溫控電流范圍-700mA-+700mA,最高輸出光功率10mW。 2.制作一個FPGA數(shù)字信號處理電路板,為光信號源的驅(qū)動電路提供所需的調(diào)制電平信號。利用ISE開發(fā)環(huán)境,以Verilog HDL語言編程實(shí)現(xiàn)任意占空比調(diào)制電平的輸出,控制光信號源輸出各種所需的光信號。 3.以單一石英晶體振蕩器為基準(zhǔn)時鐘,倍頻得到的二級時鐘為計(jì)數(shù)標(biāo)準(zhǔn),編程得到三路時鐘同步的電平信號,實(shí)現(xiàn)三路電信號時鐘同步的仿真測試。 4.將三路光信號通過3×1耦合器耦合進(jìn)示波器的一個光探測口,調(diào)節(jié)占空比、相位差以及光功率,多角度觀察光信號間的時鐘同步情況,取得較為理想的結(jié)果。
【學(xué)位授予單位】：北京交通大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2012
【分類號】：TP333;TN929.1

【參考文獻(xiàn)】

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本文編號：2527647