【摘要】：文中對可重構(gòu)三值光學處理器的原理和基本結(jié)構(gòu)進行了詳細的實驗研究,證明了這種處理器的可重構(gòu)性和重構(gòu)電路的有效性.本次研究設(shè)計了實用的重構(gòu)電路,使用小規(guī)模FPGA芯片、筆段式液晶顯示器和高速光強傳感器等元件,成功構(gòu)造了一個像素位的可重構(gòu)三值光學處理器.在實現(xiàn)的實驗系統(tǒng)上,通過精心選擇的50個實驗用例,對三值光學處理器的全部42個基元和28個代表性邏輯運算器進行了研究.50個實驗用例覆蓋了所有可能的輸入狀態(tài)和各種基元組合情況.該文是對降值設(shè)計理論的第一次全面實踐,為可重構(gòu)三值光學處理器從理論到實際應(yīng)用提供了實驗基礎(chǔ)和技術(shù)支持.
[Abstract]:In this paper, the principle and the basic structure of the reconfigurable ternary optical processor are studied in detail, and the reconfigurable property of the processor and the effectiveness of the reconfigurable circuit are proved. A small-scale FPGA chip, a pen-segment liquid crystal display (LCD) and a high-speed light intensity sensor are used to construct a pixel-bit reconfigurable ternary optical processor. In the implementation of the experimental system, through carefully selected 50 experimental use cases, All 42 primitives and 28 representative logic operators of a ternary optical processor are studied. 50 experimental use cases cover all possible input states and all kinds of primitive combinations. This paper is the first comprehensive practice of the reduced-value design theory, which provides experimental basis and technical support for the reconfigurable ternary optical processor from theory to practical application.
【作者單位】： 上海大學計算機工程與科學學院;
【基金】：國家自然科學基金(61073049) 上海市重點學科建設(shè)項目(J50103) 教育部博士點建設(shè)基金(20093108110016)資助~~
【分類號】：TP332

【參考文獻】

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【共引文獻】

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【二級參考文獻】

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本文編號：2457218