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多核處理器事務(wù)級(jí)模型多視圖協(xié)同驗(yàn)證環(huán)境

發(fā)布時(shí)間:2018-12-07 19:13
【摘要】:隨著集成電路工藝持續(xù)高速發(fā)展,片上處理器核數(shù)目呈現(xiàn)指數(shù)增長(zhǎng)規(guī)律,設(shè)計(jì)復(fù)雜程度不斷增長(zhǎng),對(duì)處理器驗(yàn)證提出了嚴(yán)峻的挑戰(zhàn),至今仍缺乏有效的工具手段。提出了一種多核處理器事務(wù)級(jí)模型的多視圖協(xié)同驗(yàn)證方法,將模擬驗(yàn)證、形式驗(yàn)證、應(yīng)用驗(yàn)證三種不同驗(yàn)證視圖,采用統(tǒng)一平臺(tái)集成為一體化驗(yàn)證環(huán)境。從而可在一體化驗(yàn)證環(huán)境中,充分發(fā)揮多種驗(yàn)證方法綜合應(yīng)用的優(yōu)勢(shì),協(xié)同高效完成多核處理器事務(wù)級(jí)模型驗(yàn)證任務(wù);赟oCLib事務(wù)級(jí)建模仿真平臺(tái)實(shí)現(xiàn)了一個(gè)具有良好可擴(kuò)展性的多視圖協(xié)同驗(yàn)證環(huán)境MVIE。初步應(yīng)用實(shí)驗(yàn)結(jié)果表明,多視圖協(xié)同驗(yàn)證和傳統(tǒng)單一視圖驗(yàn)證方法相比,在模型驗(yàn)證的方便性、完備性、高效性以及模型數(shù)據(jù)一致性維護(hù)等方面,具有明顯的優(yōu)勢(shì)。
[Abstract]:With the continuous rapid development of integrated circuit (IC) technology, the number of on-chip processor cores is increasing exponentially, and the design complexity is increasing, which poses a severe challenge to processor verification, and still lacks effective tools. In this paper, a multi-view co-verification method for multi-core processor transaction level model is proposed. Three different verification views, simulation verification, formal verification and application verification, are integrated into an integrated verification environment using a unified platform. Therefore, in the integrated verification environment, we can give full play to the advantages of the integrated application of multiple verification methods, and accomplish the task of multi-core processor transaction level model verification in cooperation and efficiency. Based on SoCLib transaction level modeling and simulation platform, a multi-view collaborative verification environment MVIE. with good scalability is implemented. The experimental results show that compared with the traditional single view verification method, multi-view collaborative verification has obvious advantages in the aspects of convenience, completeness, efficiency and consistency maintenance of model data.
【作者單位】: 國防科學(xué)技術(shù)大學(xué)高性能計(jì)算國家重點(diǎn)實(shí)驗(yàn)室;
【基金】:國家自然科學(xué)基金資助項(xiàng)目(61133007)
【分類號(hào)】:TP332

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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【相似文獻(xiàn)】

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4 司炯;李東生;;基于遺傳算法的多處理器系統(tǒng)任務(wù)調(diào)度[J];微型機(jī)與應(yīng)用;2011年10期

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相關(guān)博士學(xué)位論文 前8條

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4 謝鋮;多內(nèi)核構(gòu)件化嵌入式操作系統(tǒng)的研究[D];浙江大學(xué);2006年

5 陳娟;低功耗軟件優(yōu)化技術(shù)研究[D];國防科學(xué)技術(shù)大學(xué);2007年

6 賴明澈;同步數(shù)據(jù)觸發(fā)多核處理器體系結(jié)構(gòu)關(guān)鍵技術(shù)研究[D];國防科學(xué)技術(shù)大學(xué);2008年

7 孫小涓;海量網(wǎng)絡(luò)流實(shí)時(shí)處理的優(yōu)化技術(shù)研究[D];中國科學(xué)院研究生院(計(jì)算技術(shù)研究所);2008年

8 扈嘯;嵌入式多核處理器在線追蹤調(diào)試與錯(cuò)誤檢測(cè)關(guān)鍵技術(shù)研究[D];國防科學(xué)技術(shù)大學(xué);2007年

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2 陳龔;基于SOPC技術(shù)的多核處理器的設(shè)計(jì)與實(shí)現(xiàn)[D];華東師范大學(xué);2010年

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5 倪俊杰;基于SimpleScalar的性能和功耗分析多核模擬器[D];上海交通大學(xué);2008年

6 何進(jìn)仙;基于多核系統(tǒng)的內(nèi)存管理研究[D];電子科技大學(xué);2009年

7 潘東;多核環(huán)境任務(wù)分配問題復(fù)雜性及求解模型研究[D];大連理工大學(xué);2009年

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9 曹婷婷;基于多核處理器串行程序并行化改造和性能優(yōu)化[D];西南交通大學(xué);2009年

10 王興杰;并行嵌入式操作系統(tǒng)中斷管理的研究及應(yīng)用[D];西南交通大學(xué);2008年

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本文編號(hào):2367693

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