【摘要】：在對MIL-STD-1553B總線深入學(xué)習(xí)的基礎(chǔ)上,基于FPGA技術(shù)對1553B總線的總線控制器(BC)單元進(jìn)行了設(shè)計(jì)。設(shè)計(jì)采用了Top-Down和Down-Top混合設(shè)計(jì)的思想,使用Verilog語言進(jìn)行了代碼編寫,最后通過ISE9.0進(jìn)行了設(shè)計(jì)綜合。介紹了1553B總線特性,對BC接口功能和各模塊的設(shè)計(jì)實(shí)現(xiàn)方法進(jìn)行了詳細(xì)說明,并對結(jié)果進(jìn)行了仿真,使用示波器完成了實(shí)驗(yàn)驗(yàn)證。結(jié)果表明BC的邏輯達(dá)到了設(shè)計(jì)要求,符合1553B總線的協(xié)議規(guī)范。
[Abstract]:Based on the deep study of MIL-STD-1553B bus, the (BC) unit of 1553B bus controller is designed based on FPGA technology. The design adopts the idea of mixed design of Top-Down and Down-Top, and the code is written in Verilog language. Finally, the design is synthesized by ISE9.0. This paper introduces the characteristics of 1553B bus, explains the function of BC interface and the design and realization of each module in detail, and simulates the result, and completes the experimental verification with oscilloscope. The results show that the logic of BC meets the design requirements and conforms to the protocol specification of 1553B bus.
【作者單位】： 北京交通大學(xué)機(jī)械與電子控制工程學(xué)院;北京宇航系統(tǒng)工程研究所;
【基金】：北京交通大學(xué)優(yōu)秀博士研究生創(chuàng)新研究基金(2014YJS113)
【分類號】：TP336

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本文編號：2345971