發(fā)布時間：2018-10-08 19:21

【摘要】：隨著通信和多媒體領(lǐng)域等應(yīng)用變得越來越復(fù)雜,軟件應(yīng)用對于硬件的性能要求也越來越高,可編程多核處理器由于其既具備單核處理器的靈活性,又有比單核處理器更高的性能優(yōu)勢,成為了研究熱點。另一方面,多核處理器由于其硬件設(shè)計和軟件應(yīng)用的開發(fā)難度都非常大,利用多核處理器的系統(tǒng)級模型在硬件設(shè)計前期首先對多核系統(tǒng)架構(gòu)進行探索,并同時進行多核軟件開發(fā),這樣有利于尋求最優(yōu)架構(gòu),減少研發(fā)周期。針對這一情況,本文提出了一種多核處理器的系統(tǒng)級建模方法,并利用該建模方法構(gòu)建了一個64核的多核虛擬平臺,該虛擬平臺可用于探索多核系統(tǒng)架構(gòu)和開發(fā)多核軟件應(yīng)用。本文的主要工作如下：1.提出一種構(gòu)建多核處理器模型的方法本文提出了一種多核處理器的系統(tǒng)級建模方法,使用OVP提供的快速處理器模型,并針對特定應(yīng)用修改了單核模型,添加了一些特殊指令,OVP處理器模型由TLM2.0接口封裝;利用SystemC和TLM2.0對NoC進行全定制建模,并且利用TLM2.0接口將整個系統(tǒng)拼接起來構(gòu)成多核虛擬平臺。利用OVP的仿真工具OVPsim運行多核虛擬平臺,可以達到極高的仿真速度;采用TLM2.0的松散定時建模方法,用抽象數(shù)據(jù)類型表示多時鐘周期的傳輸,進一步加快了仿真速度。2.硬件加速單元建模本文利用OVP的Semihosting機制對多核系統(tǒng)中的硬件加速單元進行了建模,通過函數(shù)名判斷是否調(diào)用加速單元模型,在調(diào)用加速單元模型時相當于只執(zhí)行一條指令,與真實的硬件加速單元表現(xiàn)基本一致。3.NoC建模與評估本文的多核虛擬平臺對片上網(wǎng)絡(luò)進行了全定制建模,利用SystemC和TLM2.0分別對網(wǎng)絡(luò)接口、物理鏈路、路由器三個NoC組件建模,通過TLM2.0接口將各個NoC組件拼接起來構(gòu)成NoC模型。本文的多核虛擬平臺集成了第三方工具ORION2.0,實現(xiàn)了對NoC面積和功耗的評估。此外,通過跟蹤FIFO的深度信號探索FIFO深度的設(shè)定。4.多核軟件評估提出了利用多核虛擬平臺對多核軟件應(yīng)用進行評估的方法。本文構(gòu)建的多核虛擬平臺可以仿真運行多核軟件應(yīng)用,其運行結(jié)果與真實的硬件仿真沒有區(qū)別。本文的多核虛擬平臺可以提供每個核的執(zhí)行指令數(shù),以評估多核軟件應(yīng)用的性能,有助于探索多核軟件應(yīng)用的任務(wù)劃分及在多核上的映射方案。本文以LTE的下行接收鏈路載頻同步程序為例,對軟件應(yīng)用的性能進行了評估。
[Abstract]:As applications such as communications and multimedia become more and more complex, software applications require higher hardware performance. Programmable multi-core processors have the flexibility of single core processors. Also has the higher performance advantage than the single-core processor, has become the research hot spot. On the other hand, the development of multi-core processor is very difficult because of its hardware design and software application, so the system level model of multi-core processor is used to explore the architecture of multi-core system in the early stage of hardware design. At the same time, multi-core software development is carried out, which is helpful to seek the optimal architecture and reduce the R & D cycle. In this paper, a system-level modeling method for multi-core processors is proposed, and a 64-core multi-core virtual platform is constructed, which can be used to explore the architecture of multi-core systems and develop multi-core software applications. The main work of this paper is as follows: 1. In this paper, a system-level modeling method of multi-core processor is presented, which uses the fast processor model provided by OVP, and modifies the single-core model for specific applications. Some special instructions are added to encapsulate the TLM2.0 processor model, SystemC and TLM2.0 are used to fully customize the NoC model, and the TLM2.0 interface is used to assemble the whole system to form a multi-core virtual platform. Using the simulation tool OVPsim of OVP to run the multi-core virtual platform, the simulation speed can be very high, and the loose timing modeling method of TLM2.0 is used to express the transmission of multi-clock cycle with abstract data type, which further speeds up the simulation speed of .2. In this paper, we use the Semihosting mechanism of OVP to model the hardware acceleration unit in the multi-core system. We use the function name to determine whether to call the acceleration unit model, which is equivalent to executing only one instruction when calling the acceleration unit model. The modeling and evaluation of the multi-core virtual platform in this paper is basically consistent with the actual performance of the hardware acceleration unit. SystemC and TLM2.0 are used to model the three NoC components of the network interface, physical link and router, respectively. Through the TLM2.0 interface, each NoC component is spliced together to form the NoC model. The multi-core virtual platform integrates the third party tool ORION2.0, to evaluate the area and power consumption of NoC. In addition, by tracking the FIFO depth signal to explore the FIFO depth setting. 4. 4. A method of multi-core software application evaluation based on multi-core virtual platform is proposed. The multi-core virtual platform constructed in this paper can simulate and run multi-core software applications, and the results are no different from the real hardware simulation. The multi-core virtual platform in this paper can provide the number of execution instructions for each core to evaluate the performance of multi-core software applications and help to explore the task partition and mapping schemes on multi-core software applications. Taking the downlink carrier frequency synchronization program of LTE as an example, the performance of software application is evaluated.
【學(xué)位授予單位】：復(fù)旦大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2014
【分類號】：TP332

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本文編號：2257970