【摘要】：隨著嵌入式產(chǎn)品的迅速發(fā)展以及產(chǎn)品設(shè)計(jì)的越來越開放，嵌入式產(chǎn)品的知識(shí)產(chǎn)權(quán)保護(hù)日益成為產(chǎn)品開發(fā)者關(guān)注的焦點(diǎn)，同質(zhì)化的硬件解決方案使得越來越多的產(chǎn)品開發(fā)者將其核心競(jìng)爭(zhēng)力融入在嵌入式軟件內(nèi)，因此如何保護(hù)嵌入式軟件安全成為了保護(hù)嵌入式產(chǎn)品的關(guān)鍵。文章首先分析了嵌入式軟件的特點(diǎn)以及安全威脅來源，然后介紹了幾種常見的嵌入式軟件防護(hù)方案及其優(yōu)缺點(diǎn)，在此基礎(chǔ)上提出一種基于AES的安全協(xié)處理器的嵌入式軟件防護(hù)機(jī)制，并對(duì)該安全協(xié)處理器進(jìn)行了設(shè)計(jì)實(shí)現(xiàn)。 基于協(xié)處理器的嵌入式軟件防護(hù)機(jī)制有效解決了純軟件保護(hù)方案占用系統(tǒng)資源大的短板，以及其他硬件保護(hù)方案只單一提供身份認(rèn)證的不足。該安全協(xié)處理器采用異構(gòu)S盒的AES協(xié)處理器對(duì)主機(jī)身份進(jìn)行驗(yàn)證以及對(duì)用戶數(shù)據(jù)和程序進(jìn)行加密處理，同時(shí)內(nèi)置的EEPROM存儲(chǔ)器能夠?qū)τ脩魯?shù)據(jù)及程序進(jìn)行安全存儲(chǔ)。考慮到嵌入式系統(tǒng)資源有限等特點(diǎn)，安全處理器設(shè)計(jì)實(shí)現(xiàn)過程中采取多種優(yōu)化結(jié)構(gòu)和算法以在安全性、面積、速度和功耗之間取得良好平衡。 在系統(tǒng)架構(gòu)的基礎(chǔ)上，對(duì)各個(gè)功能模塊進(jìn)行劃分，按照ASIC設(shè)計(jì)的標(biāo)準(zhǔn)流程，用verilog硬件描述語言對(duì)該協(xié)處理器進(jìn)行設(shè)計(jì)，然后采用Modelsim進(jìn)行功能仿真，搭建FPGA平臺(tái)進(jìn)行硬件驗(yàn)證，在HuaHong NEC0.35微米工藝庫下采用DesignCompiler進(jìn)行綜合，并用Astro對(duì)其進(jìn)行后端版圖設(shè)計(jì)，，最終在HuaHong NEC成功實(shí)現(xiàn)流片，并對(duì)流片后的芯片搭建硬件平臺(tái)進(jìn)行測(cè)試，測(cè)試結(jié)果表明該安全協(xié)處理器能夠滿足預(yù)期要求。
[Abstract]:With the rapid development of embedded products and the increasing openness of product design, intellectual property protection of embedded products has increasingly become the focus of product developers. The homogenous hardware solution makes more and more product developers integrate their core competence into embedded software, so how to protect the security of embedded software becomes the key to protect embedded products. This paper first analyzes the characteristics of embedded software and the source of security threats, then introduces several common embedded software protection schemes and their advantages and disadvantages. On this basis, an embedded software protection mechanism based on AES security coprocessor is proposed, and the security coprocessor is designed and implemented. The embedded software protection mechanism based on coprocessor effectively solves the problem that pure software protection schemes occupy large system resources and other hardware protection schemes only provide identity authentication. The security coprocessor uses the heterogeneous S-box AES coprocessor to verify the host identity and encrypt the user data and programs. Meanwhile, the built-in EEPROM memory can store the user data and programs safely. Considering the limited resources of embedded system, a variety of optimization structures and algorithms are adopted in the design and implementation of the security processor to achieve a good balance among security, area, speed and power consumption. On the basis of the system architecture, each functional module is divided into two parts. According to the standard flow of ASIC design, the coprocessor is designed with verilog hardware description language, and then Modelsim is used to simulate the function, and the FPGA platform is built for hardware verification. In the HuaHong NEC0.35 micron process library, DesignCompiler is used to synthesize, and the back-end layout is designed with Astro. Finally, the flow sheet is successfully realized in HuaHong NEC, and the chip behind the convection chip is built up to test the hardware platform. The test results show that the security coprocessor can meet the expected requirements.
【學(xué)位授予單位】：華中科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2012
【分類號(hào)】：TP368.1

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5 章成e

本文編號(hào)：2253756