【摘要】：為滿足SoC外設(shè)接口高帶寬、外部電路接口多樣性的要求,利用可編程狀態(tài)機(jī)和波形描述符存儲器,設(shè)計了一種通用可編程接口IP核。分別從接口硬件連接設(shè)計、固件程序設(shè)計、波形描述符設(shè)計和仿真平臺設(shè)計等方面對接口的設(shè)計流程進(jìn)行了詳述。以8051 CPU核為基礎(chǔ),利用所設(shè)計的接口IP核構(gòu)建了仿真驗(yàn)證環(huán)境,對接口IP核編程后實(shí)現(xiàn)了對外部存儲器的訪問,并通過比較寫出和讀入的數(shù)據(jù)驗(yàn)證了設(shè)計的正確性。
[Abstract]:In order to meet the requirements of high bandwidth of SoC peripheral interface and diversity of external circuit interface, a general programmable interface (IP) core is designed by using programmable state machine and waveform descriptor memory. The design process of the interface is described in detail from the aspects of interface hardware connection design, firmware program design, waveform descriptor design and simulation platform design. Based on the 8051 CPU core, the simulation verification environment is constructed by using the designed interface IP core. After programming the interface IP core, the external memory is accessed, and the correctness of the design is verified by comparing the data written out and read in.
【作者單位】： 江南大學(xué)電子工程系輕工過程先進(jìn)控制教育部重點(diǎn)實(shí)驗(yàn)室;中國電子科技集團(tuán)公司第五十八研究所;
【基金】：江蘇省自然科學(xué)基金(BK20130156) 中央高�；究蒲袠I(yè)務(wù)費(fèi)專項(xiàng)資金(JUSRP1026,JUSRP51323B) 江蘇省科技廳產(chǎn)學(xué)研聯(lián)合創(chuàng)新資金(BY2013015-19) 江蘇省六大人才高峰資助項(xiàng)目(DZXX-027) 江蘇省普通高校研究生實(shí)踐創(chuàng)新計劃項(xiàng)目(SJZZ_0148)
【分類號】：TP334.7

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本文編號：2225488