本文選題：多核處理器 + 并行調(diào)試�。� 參考：《高技術(shù)通訊》2017年06期

【摘要】：針對(duì)多核處理器上并行程序執(zhí)行不確定性所造成的并行調(diào)試難問(wèn)題,提出了一種基于硬件的快速確定性重放方法——時(shí)間切割者。該方法采用面向并行的記錄機(jī)制來(lái)區(qū)分出原執(zhí)行中并行執(zhí)行的訪存指令塊和非并行執(zhí)行的指令塊,并在重放執(zhí)行中避免串行執(zhí)行那些在原執(zhí)行中并行執(zhí)行的訪存指令塊,從而使得重放執(zhí)行的性能開銷小。在多核模擬器Sim-Godson上的仿真實(shí)驗(yàn)結(jié)果表明:該方法的重放速度快,其性能開銷僅為2%左右。此外,該方法還具有硬件支持簡(jiǎn)單特點(diǎn),未來(lái)有望應(yīng)用于國(guó)產(chǎn)多核處理器研制中。
[Abstract]:Aiming at the difficulty of parallel debugging caused by the uncertainty of parallel program execution on multi-core processors, a fast deterministic replay method based on hardware, time cutter, is proposed. The method uses parallelism oriented recording mechanism to distinguish memory access instruction blocks from non-parallel execution instruction blocks in original execution, and avoids serial execution of memory access instruction blocks that are executed in parallel in original execution during playback execution. As a result, the performance overhead of replay execution is low. The simulation results on a multi-core simulator Sim-Godson show that the replay speed of this method is high and the performance cost is only about 2%. In addition, the method has the characteristics of simple hardware support and is expected to be used in the development of domestic multi-core processors in the future.
【作者單位】： 計(jì)算機(jī)體系結(jié)構(gòu)國(guó)家重點(diǎn)實(shí)驗(yàn)室(中國(guó)科學(xué)院計(jì)算技術(shù)研究所);中國(guó)科學(xué)院大學(xué);中國(guó)科學(xué)院計(jì)算技術(shù)研究所;龍芯中科技術(shù)有限公司;華為技術(shù)有限公司;
【基金】：國(guó)家“核高基”科技重大專項(xiàng)課題(2009ZX01028-002-003,2009ZX01029-001-003,2010ZX01036-001-002,2012ZX01029-001-002-002) 國(guó)家自然科學(xué)基金(61221062,61232009,61222204) 863計(jì)劃(2012AA010901)資助項(xiàng)目
【分類號(hào)】：TP332

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本文編號(hào)：2101193