發(fā)布時(shí)間：2018-07-03 08:06

  本文選題：片上系統(tǒng) + 網(wǎng)絡(luò)接口控制器�。� 參考：《計(jì)算機(jī)測(cè)量與控制》2014年06期

【摘要】：為了實(shí)現(xiàn)一種基于FPGA及片上系統(tǒng)(SOC)的智能以太網(wǎng)接口設(shè)計(jì),在FPGA內(nèi)集成了PowerPC440硬核處理器、以太網(wǎng)絡(luò)接口控制器IP(TEMAC)、DDR2控制器、通用串行接口IP核及定時(shí)器等;該設(shè)計(jì)使用Verilog HDL硬件描述語(yǔ)言,在ISE12.4下的嵌入式集成開(kāi)發(fā)環(huán)境XPS下進(jìn)行IP核定制、系統(tǒng)的集成設(shè)計(jì)、綜合、布局布線,在Model Sim下完成功能、時(shí)序仿真,在SDK環(huán)境下完成片上系統(tǒng)軟件程序的開(kāi)發(fā);最后在XILINX的Virtex-5系列FPGA器件上實(shí)現(xiàn)了具有千兆以太網(wǎng)絡(luò)接口的智能片上系統(tǒng),智能網(wǎng)絡(luò)接口具有可重配置、可擴(kuò)展性、靈活性、兼容性、功耗低等優(yōu)點(diǎn)。
[Abstract]:In order to realize an intelligent Ethernet interface design based on FPGA and SOC, PowerPC440 hard core processor, Ethernet interface controller IP (TEMAC) DDR2 controller, universal serial interface IP core and timer are integrated in FPGA. This design uses Verilog HDL hardware description language, carries on the IP approval system under the embedded integrated development environment XPS under ISE12.4, the system integration design, the synthesis, the layout wiring, completes the function under the Model Sim, timing simulation, The software program of on-chip system is developed in SDK environment. Finally, the intelligent on-chip system with gigabit Ethernet network interface is implemented on the Virtex-5 series FPGA devices of XILINX. The intelligent network interface is reconfigurable, extensible and flexible. Compatibility, low power consumption and other advantages.
【作者單位】： 江蘇自動(dòng)化研究所;
【分類(lèi)號(hào)】：TP334.7

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本文編號(hào)：2092977