本文選題：異構(gòu)千核處理器 + 內(nèi)存地址空間�。� 參考：《國(guó)防科技大學(xué)學(xué)報(bào)》2015年01期

【摘要】：為了達(dá)到異構(gòu)多核處理器能直接交叉訪問對(duì)方的內(nèi)存地址空間的目的,通過構(gòu)建統(tǒng)一的三級(jí)Cache結(jié)構(gòu)和數(shù)據(jù)塊狀態(tài)標(biāo)記方法,并優(yōu)化Cache塊狀態(tài)的修改算法,提出了異構(gòu)千核處理器系統(tǒng)的統(tǒng)一內(nèi)存地址空間訪問方法,避免了當(dāng)前獨(dú)立式異構(gòu)計(jì)算機(jī)系統(tǒng)結(jié)構(gòu)下復(fù)制和傳輸數(shù)據(jù)塊所帶來的大量額外訪存開銷。通過采用部分Rodinia基準(zhǔn)測(cè)試程序測(cè)試,獲得了最高9.8倍的系統(tǒng)加速比,最多減少了90%的訪存頻率。因此,采用該方法能有效減少異構(gòu)核心間交換數(shù)據(jù)塊所帶來的系統(tǒng)開銷,提高異構(gòu)千核處理器的系統(tǒng)性能加速比。
[Abstract]:In order to achieve the purpose that heterogeneous multi-core processors can directly cross access each other's memory address space, a unified three-level cache structure and a data block state marking method are constructed and the Cache block state modification algorithm is optimized. A unified memory address space access method for heterogeneous thousand core processor systems is proposed to avoid a large amount of additional memory access overhead caused by replication and transmission of data blocks under the current independent heterogeneous computer system architecture. By using part of the Rodinia benchmark program, the system speedup of 9.8 times is obtained, and the frequency of memory access is reduced by 90%. Therefore, this method can effectively reduce the system overhead caused by the exchange of data blocks between heterogeneous cores, and improve the system performance speedup of heterogeneous thousand core processors.
【作者單位】： 上海理工大學(xué)計(jì)算機(jī)科學(xué)與工程系;中國(guó)科學(xué)院計(jì)算機(jī)體系結(jié)構(gòu)國(guó)家重點(diǎn)實(shí)驗(yàn)室;加利福尼亞大學(xué)電氣工程與計(jì)算機(jī)科學(xué)系;貴州大學(xué)計(jì)算機(jī)科學(xué)與技術(shù)學(xué)院;科羅拉多科技大學(xué)計(jì)算機(jī)科學(xué)學(xué)院;
【基金】：計(jì)算機(jī)體系結(jié)構(gòu)國(guó)家重點(diǎn)實(shí)驗(yàn)室開放資助項(xiàng)目(CARCH201206) 上海理工大學(xué)國(guó)家級(jí)項(xiàng)目培育基金資助項(xiàng)目(12XGQ07) 貴陽市科技計(jì)劃項(xiàng)目(2011101414) 貴州省科技支撐項(xiàng)目(20123050)
【分類號(hào)】：TP332

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本文編號(hào)：2060337