本文選題：數(shù)據(jù)發(fā)生器 + 動(dòng)態(tài)存儲(chǔ)器��； 參考：《電子科技大學(xué)》2012年碩士論文

【摘要】：數(shù)據(jù)發(fā)生器作為現(xiàn)代數(shù)據(jù)域測(cè)試中的通用數(shù)字信號(hào)源,可以產(chǎn)生大數(shù)據(jù)量、復(fù)雜多樣的高速數(shù)字激勵(lì)信號(hào)。隨著現(xiàn)代科技水平的快速發(fā)展,待測(cè)設(shè)備的工作速度不斷提高以及系統(tǒng)功能更加復(fù)雜化,相應(yīng)的對(duì)數(shù)據(jù)發(fā)生器的數(shù)據(jù)輸出速率和數(shù)據(jù)存儲(chǔ)深度提出了更高要求,因此需要高速大容量存儲(chǔ)器件作為圖形數(shù)據(jù)存儲(chǔ)器。 隨著存儲(chǔ)器件的不斷發(fā)展,動(dòng)態(tài)存儲(chǔ)器的出現(xiàn)極大的推動(dòng)了高速數(shù)據(jù)流產(chǎn)生技術(shù)的研發(fā)。本論文首先介紹了動(dòng)態(tài)存儲(chǔ)器高速傳輸數(shù)據(jù)的工作原理,對(duì)其讀寫(xiě)數(shù)據(jù)過(guò)程進(jìn)行了深入研究,并通過(guò)分析數(shù)據(jù)發(fā)生器功能和指標(biāo)要求,提出采用動(dòng)態(tài)存儲(chǔ)器作為圖形數(shù)據(jù)存儲(chǔ)器,以及采用異步FIFO對(duì)動(dòng)態(tài)存儲(chǔ)器輸出數(shù)據(jù)進(jìn)行緩存以達(dá)到數(shù)據(jù)無(wú)縫輸出的要求,確定了基于動(dòng)態(tài)存儲(chǔ)的高速數(shù)據(jù)流產(chǎn)生系統(tǒng)總體設(shè)計(jì)方案。 然后根據(jù)高速數(shù)據(jù)流產(chǎn)生系統(tǒng)的數(shù)據(jù)輸出特點(diǎn)再結(jié)合動(dòng)態(tài)存儲(chǔ)器的讀寫(xiě)數(shù)據(jù)過(guò)程,設(shè)計(jì)了基于動(dòng)態(tài)存儲(chǔ)的數(shù)據(jù)產(chǎn)生控制電路,以及具有正確讀寫(xiě)動(dòng)態(tài)存儲(chǔ)器和無(wú)縫輸出圖形數(shù)據(jù)功能的DDR2存儲(chǔ)模塊,最終實(shí)現(xiàn)了2Gbps數(shù)據(jù)流輸出和單通道256Mbits存儲(chǔ)深度的雙通道高速數(shù)據(jù)流產(chǎn)生系統(tǒng)。 完成高速數(shù)據(jù)流產(chǎn)生系統(tǒng)與上位機(jī)控制系統(tǒng)(以Arm為控制核心)之間的接口模塊設(shè)計(jì),使上位機(jī)與數(shù)據(jù)流產(chǎn)生板能夠進(jìn)行數(shù)據(jù)信號(hào)通信,最終實(shí)現(xiàn)了在多種觸發(fā)方式和運(yùn)行模式下的高速數(shù)據(jù)流輸出。
[Abstract]:As a universal digital signal source in modern data domain testing, data generator can generate large amount of data and complex high-speed digital excitation signal. With the rapid development of modern science and technology, the working speed of the equipment to be tested has been improved and the system function has become more complicated. Accordingly, the data output rate and the data storage depth of the data generator are required to be higher. Therefore, high speed and large capacity memory devices are needed as graphics data memory. With the continuous development of memory devices, the emergence of dynamic memory greatly promotes the development of high-speed data stream generation technology. In this paper, the principle of high speed data transmission in dynamic memory is introduced, and the process of reading and writing data is deeply studied, and the function and index requirement of data generator are analyzed. Dynamic memory is used as graphic data memory, and asynchronous FIFO is used to cache the output data of dynamic memory to achieve seamless data output. The overall design scheme of high speed data stream generation system based on dynamic storage is determined. Then according to the data output characteristics of high-speed data stream generation system and combined with the process of reading and writing data in dynamic memory, a data generation control circuit based on dynamic storage is designed. And the DDR2 storage module, which can read and write dynamic memory correctly and output graph data seamlessly, realizes the 2Gbps data stream output and single-channel 256Mbits storage depth two-channel high-speed data stream generation system. The design of the interface module between the high speed data stream generation system and the host computer control system (Arm as the control core) enables the data signal communication between the upper computer and the data stream generator board. Finally, the output of high-speed data stream in various trigger modes and running modes is realized.
【學(xué)位授予單位】：電子科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2012
【分類(lèi)號(hào)】：TP333

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本文編號(hào)：1981210