本文選題：串擾 + 近端串擾�。� 參考：《浙江工業(yè)大學學報》2016年03期

【摘要】：隨著系統(tǒng)的工作頻率及信號邊沿轉(zhuǎn)換速率的不斷提高,串擾對于信號完整性的影響日益突出.通過對傳輸線串擾形成機理的分析,使用Cadence仿真軟件對系統(tǒng)中的DDR2SDRAM的數(shù)據(jù)線進行串擾仿真,給出了合理處理串擾問題的解決方案.對于數(shù)據(jù)線的近端串擾和遠端串擾仿真分析,在理論及仿真結(jié)果的基礎上,可以通過減小耦合線長度、增大耦合線間距和減小反射等方法降低串擾對于電路的影響.筆者提出了PCB設計中抑制串擾的一些有效措施,對于DDR2SDRAM的信號完整性設計有一定的指導意義.
[Abstract]:With the increasing of the operating frequency and the signal edge conversion rate, crosstalk has more and more influence on the signal integrity. Based on the analysis of the formation mechanism of transmission line crosstalk, the Cadence simulation software is used to simulate the crosstalk of DDR2SDRAM data lines in the system, and the solution to the crosstalk problem is given. Based on the theoretical and simulation results, the influence of crosstalk on circuits can be reduced by reducing the length of coupling lines, increasing the spacing of coupling lines and reducing reflection. In this paper, some effective measures to suppress crosstalk in PCB design are put forward, which can be used to guide the signal integrity design of DDR2SDRAM.
【作者單位】： 浙江工業(yè)大學信息工程學院;
【分類號】：TP333

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本文編號：1968278