本文選題：以太網(wǎng) + 物理編碼子層��； 參考：《國防科學(xué)技術(shù)大學(xué)》2015年碩士論文

【摘要】：在當(dāng)前電子設(shè)備日趨網(wǎng)絡(luò)化時代,越來越多的電子設(shè)備要求具有聯(lián)網(wǎng)功能。以太網(wǎng)作為最重要的網(wǎng)絡(luò)通信技術(shù)之一,由于其具有結(jié)構(gòu)簡單、靈活、易擴展、可靠性高、實現(xiàn)成本低、軟硬件資源豐富等諸多優(yōu)點成為了當(dāng)前眾多嵌入式設(shè)備的首選。本文以國防科技大學(xué)自主開發(fā)的多核高性能微處理器FT-XDSP為依托,設(shè)計開發(fā)了FT-XDSP外設(shè)部件以太網(wǎng)接口控制器MAC模塊的物理編碼子層(physical coding sublayer,PCS)單元,使其能夠正確地集成在MAC控制器中實現(xiàn)預(yù)定的功能。根據(jù)FT-XDSP物理編碼子層單元的功能需求,對以太網(wǎng)體系結(jié)構(gòu)相關(guān)協(xié)議進行了深入研究,本文主要完成了以下工作:1、根據(jù)物理編碼子層單元要實現(xiàn)的功能需求對其進行了總體設(shè)計,并采用自頂向下的方法對物理編碼單元進行了模塊劃分。劃分后的物理編碼子層單元包含了發(fā)送處理、接收處理、沖突檢測、載波偵測、8B/10B編解碼、自協(xié)商處理、同步檢測等模塊;2、在對每個單元實現(xiàn)原理以及實現(xiàn)過程充分掌握的基礎(chǔ)上使用Verilog硬件描述語言對每個單元模塊進行了功能描述;3、搭建了模塊級以及系統(tǒng)級驗證平臺,制定了詳細的驗證計劃,并對物理編碼子層單元的各個功能點從模塊級到系統(tǒng)級進行了全面驗證,驗證結(jié)果表明物理編碼子層單元功能設(shè)計正確,并且集成在MAC控制器后能正常進行工作。4、在40nm工藝下,使用DC工具對物理編碼子層單元進行了邏輯綜合。綜合后物理編碼子層單元的面積為3409.223927,功耗為0.2251mw,最后達到500MHz設(shè)計指標(biāo)。
[Abstract]:In this paper , the physical coding sublayer ( PCS ) unit of Ethernet interface controller MAC module is designed and developed based on the multi - core high - performance microprocessor FT - XDSP which is developed by National Defense Science and Technology University .

【學(xué)位授予單位】：國防科學(xué)技術(shù)大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2015
【分類號】：TP332;TP393.11

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本文編號：1857233