本文選題：嵌入式系統(tǒng)　切入點(diǎn)：抗干擾數(shù)據(jù)　出處：《科技通報(bào)》2015年04期

【摘要】：提出一種基于S3C6410A的抗干擾數(shù)據(jù)電能校驗(yàn)調(diào)度嵌入式系統(tǒng)的設(shè)計(jì),通過(guò)抗干擾數(shù)據(jù)的檢測(cè),對(duì)檢測(cè)參數(shù)進(jìn)行數(shù)據(jù)電能校驗(yàn)調(diào)度,建立一個(gè)基于S3C6410A抗干擾核心處理器與嵌入式操作系統(tǒng)的設(shè)計(jì)平臺(tái),利用高效能的方法檢測(cè)干擾數(shù)據(jù),通過(guò)對(duì)抗干擾數(shù)據(jù)的分析,并進(jìn)行電能校驗(yàn)調(diào)度,建立嵌入式系統(tǒng)設(shè)計(jì)程序,完成對(duì)其數(shù)據(jù)參數(shù)進(jìn)行分析的過(guò)程。仿真實(shí)驗(yàn)表明,基于S3C6410A的抗干擾數(shù)據(jù)電能校驗(yàn)調(diào)度嵌入式系統(tǒng)能夠通過(guò)定義抗干擾數(shù)據(jù)模型來(lái)實(shí)現(xiàn)對(duì)舊方法的改變,且可靈活增加或刪除相應(yīng)驗(yàn)證的能力,滿足嵌入式系統(tǒng)設(shè)計(jì)模型重復(fù)驗(yàn)證和評(píng)估的要求,從而得到更為高性能、低功耗、低成本的抗干擾數(shù)據(jù)電能校驗(yàn)調(diào)度嵌入式系統(tǒng),促進(jìn)了嵌入式系統(tǒng)設(shè)計(jì)方法的新發(fā)展。
[Abstract]:In this paper, an embedded system of anti-interference data check and dispatch based on S3C6410A is proposed. Through the detection of anti-interference data, the test parameters are checked and scheduled. A design platform based on S3C6410A anti-jamming core processor and embedded operating system is established. The interference data is detected by high-efficiency method. Through the analysis of anti-interference data, the power power check and scheduling is carried out. The design program of embedded system is established, and the process of analyzing its data parameters is completed. The simulation results show that, The anti-jamming data power check and dispatch embedded system based on S3C6410A can change the old method by defining the anti-jamming data model, and can flexibly increase or delete the ability of corresponding verification. It can meet the requirements of repeated verification and evaluation of embedded system design model, so as to obtain higher performance, lower power consumption and lower cost of anti-interference data power check and scheduling embedded system, which promotes the new development of embedded system design method.
【作者單位】： 福建工程學(xué)院信息科學(xué)與工程學(xué)院;
【分類號(hào)】：TP368.1

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本文編號(hào)：1700561