本文選題：VLIW　切入點(diǎn)：DSP　出處：《小型微型計(jì)算機(jī)系統(tǒng)》2015年08期 　論文類型：期刊論文

【摘要】：當(dāng)今VLIW DSP處理器擁有的指令種類越來(lái)越多,它們大多利用單一指令來(lái)完成一組復(fù)雜的計(jì)算,從而提高相關(guān)操作的執(zhí)行效率.無(wú)論是在現(xiàn)有數(shù)字信號(hào)處理程序中,還是使用各種優(yōu)化手段之后的程序代碼中,累加計(jì)算在VLIW DSP處理器運(yùn)算的程序中總是頻繁出現(xiàn),編譯器如何自動(dòng)高效地識(shí)別并合成處理器特有的累加指令就變得尤為重要.提出一種VLIW DSP處理器下累加計(jì)算優(yōu)化方法,算法可以自動(dòng)合成目標(biāo)處理器的累加指令,充分利用處理器體系結(jié)構(gòu)和資源的特點(diǎn).最后在BWDSP處理器上實(shí)現(xiàn)本文的優(yōu)化算法,實(shí)驗(yàn)結(jié)果表明,本算法有效減小了程序累加部分的匯編代碼長(zhǎng)度,從而提高了BWDSP對(duì)累加計(jì)算的處理能力.
[Abstract]:Nowadays, VLIW DSP processors have more and more kinds of instructions, most of which use a single instruction to complete a complex set of calculations, thus improving the efficiency of the execution of related operations, whether in the existing digital signal processing programs, Still, in code that uses various optimizations, cumulative computing is often present in programs that are run by VLIW DSP processors. It is very important for the compiler to recognize and synthesize the specific accumulative instructions of the processor automatically and efficiently. This paper presents an optimization method of accumulative computation under the VLIW DSP processor, which can automatically synthesize the accumulative instructions of the target processor. Finally, the optimization algorithm is implemented on the BWDSP processor. The experimental results show that the algorithm can effectively reduce the length of assembly code in the cumulative part of the program. Thus, the ability of BWDSP to deal with accumulative computation is improved.
【作者單位】： 中國(guó)科學(xué)技術(shù)大學(xué)計(jì)算機(jī)學(xué)院;安徽省計(jì)算與通信軟件重點(diǎn)實(shí)驗(yàn)室;
【基金】：國(guó)家“核高基”重大專項(xiàng)項(xiàng)目(2009ZX01028-002-003-005)資助 國(guó)家自然科學(xué)基金項(xiàng)目(60833004)資助
【分類號(hào)】：TP332

【參考文獻(xiàn)】

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【共引文獻(xiàn)】

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本文編號(hào)：1606058