本文關(guān)鍵詞： 多周期CPU 有限狀態(tài)機(jī) 實驗設(shè)計 FPGA　出處：《實驗技術(shù)與管理》2017年07期 　論文類型：期刊論文

【摘要】：設(shè)計了一個基于FPGA的多周期CPU實驗,并將有限狀態(tài)機(jī)應(yīng)用于模型計算機(jī)的設(shè)計與實現(xiàn)。模型計算機(jī)基于MIPS處理器,含8條典型指令。給出了多周期CPU的數(shù)據(jù)通路與指令流程圖,并按照有限狀態(tài)機(jī)的設(shè)計方法,完成了狀態(tài)轉(zhuǎn)移圖的設(shè)計和HDL的程序描述。實驗不僅使學(xué)生掌握有限狀態(tài)機(jī)這一重要的數(shù)字系統(tǒng)設(shè)計工具,同時也有助于學(xué)生加深理解"計算機(jī)就是一個有限狀態(tài)機(jī)"的概念。在課程實踐應(yīng)用中教學(xué)效果良好。
[Abstract]:A multi-period CPU experiment based on FPGA is designed, and the finite state machine is applied to the design and implementation of the model computer. The model computer is based on the MIPS processor and contains 8 typical instructions. The data path and instruction flow chart of the multi-period CPU are given. According to the design method of finite state machine, the design of state transition graph and the program description of HDL are completed. The experiment not only enables students to master the finite state machine as an important digital system design tool. At the same time, it also helps students to understand the concept of "computer is a finite state machine".
【作者單位】： 杭州電子科技大學(xué)計算機(jī)學(xué)院;
【基金】：教育部國家精品資源共享課程“計算機(jī)組成原理” 浙江省教育技術(shù)研究規(guī)劃課題(JA007)
【分類號】：TP332

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本文編號：1524271