本文關(guān)鍵詞： 磁盤陣列 雙控制服務(wù)器 同步通道　出處：《華中科技大學(xué)》2012年碩士論文　論文類型：學(xué)位論文

【摘要】：為了提高數(shù)據(jù)存儲(chǔ)的可靠性，雙控制器磁盤陣列使用越來(lái)越廣泛。在雙控盤陳列中，控制器間的數(shù)據(jù)同步是決定其性能和可靠性的關(guān)鍵因素。在自主研發(fā)的雙控中，采用PCI-e作為同步通道，可以在傳輸速率上滿足性能要求。但其本身也存在許多的問(wèn)題。一方面，PCI-e板卡使用RDMA傳輸方式，在傳輸小塊數(shù)據(jù)時(shí)性能會(huì)急劇下降。另一方面，傳統(tǒng)的PCI-e通信設(shè)計(jì)是針對(duì)于多點(diǎn)（節(jié)點(diǎn)數(shù)2）的情況，而在雙控制服務(wù)器磁盤陣列中的數(shù)據(jù)同步是一種點(diǎn)到點(diǎn)的傳輸模式。因此，一方面需要解決傳輸小塊數(shù)據(jù)的問(wèn)題。另一方面需要簡(jiǎn)化現(xiàn)有的PCI-e傳輸層次。 在傳輸方式中，SISCI層中的共享內(nèi)存是直接由CPU來(lái)掌管的傳輸方式，在存儲(chǔ)小塊數(shù)據(jù)時(shí)不會(huì)有性能下降的問(wèn)題。在改進(jìn)之后的傳輸模式中，選擇將RDMA和共享內(nèi)存的傳輸方式結(jié)合起來(lái)。在發(fā)送方發(fā)送結(jié)束后，使用中斷的方式來(lái)通知接收方已經(jīng)發(fā)送完畢，解放CPU去完成其他的工作。在傳輸?shù)拈_始和結(jié)束時(shí)，分別有錯(cuò)誤檢測(cè)模塊來(lái)進(jìn)行錯(cuò)誤檢測(cè)，并發(fā)送錯(cuò)誤報(bào)告。整個(gè)接口應(yīng)用在SISCI層之上，避開了supersocket層上繁瑣的管理步驟，簡(jiǎn)化了PCI-e的層次結(jié)構(gòu)。 在對(duì)PCI-e做出改進(jìn)之后，使用共享內(nèi)存的方式解決了其在傳輸小塊數(shù)據(jù)時(shí)的速率下降問(wèn)題，同時(shí)保留了RDMA在傳輸大塊數(shù)據(jù)的傳輸高效性。改進(jìn)之后在傳輸小塊數(shù)據(jù)時(shí)，傳輸速率提升4-6倍。改進(jìn)之后的傳輸通道一方面作為程序的接口，可以被Cache同步模塊直接調(diào)用，，可以根據(jù)用戶的需求，選擇合適的數(shù)據(jù)塊大小進(jìn)行傳輸。同時(shí)，可以通過(guò)包括錯(cuò)誤檢測(cè)，中斷提示來(lái)保證數(shù)據(jù)傳輸?shù)耐暾浴?br/>[Abstract]:In order to improve the reliability of data storage, dual-controller disk array is more and more widely used. In dual-controller display, data synchronization between controllers is the key factor to determine its performance and reliability. Using PCI-e as the synchronization channel can meet the performance requirements in the transmission rate. However, there are many problems in itself. On the one hand, the performance of PCI-e card with RDMA transmission mode will drop sharply when transmitting small data, on the other hand, The traditional design of PCI-e communication is aimed at the situation of multi-point (2 points), but the data synchronization in the dual-control server disk array is a point-to-point transmission mode. On the one hand, we need to solve the problem of transferring small pieces of data, on the other hand, we need to simplify the existing PCI-e transport hierarchy. The shared memory in the SISCI layer in the transport mode is directly managed by CPU, and there is no problem of performance degradation when storing small pieces of data. Select a combination of RDMA and shared memory transport. After the sender sends, use an interrupt to notify the receiver that the sending has finished, liberate the CPU to do other work. At the beginning and end of the transmission, The whole interface is applied on the SISCI layer, avoiding the tedious management steps on the supersocket layer, and simplifies the hierarchy of PCI-e. After the improvement of PCI-e, it solves the problem of rate decreasing when transferring small pieces of data by using shared memory, while keeping the efficiency of transferring large pieces of data in RDMA. The transmission rate is increased 4-6 times. The improved transmission channel can be called directly by the Cache synchronization module, on the one hand, as the interface of the program. At the same time, it can select the appropriate data block size for transmission according to the needs of the user. At the same time, The integrity of data transmission can be ensured by including error detection and interrupt prompts.
【學(xué)位授予單位】：華中科技大學(xué)
【學(xué)位級(jí)別】：碩士
【學(xué)位授予年份】：2012
【分類號(hào)】：TP333.35

【參考文獻(xiàn)】

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本文編號(hào)：1510992