本文關(guān)鍵詞： FPGA FIFO SDRAM控制器 仲裁器　出處：《液晶與顯示》2014年04期 　論文類型：期刊論文

【摘要】：介紹一種基于FPGA和SDRAM的雙端口的視頻緩沖器設(shè)計(jì)方法。使用小容量的同步FIFO和異步FIFO串聯(lián)構(gòu)成用戶接口,采用分塊方式讀寫單塊存儲(chǔ)器SDRAM,采用混合算法合理仲裁讀、寫和刷新請(qǐng)求,實(shí)現(xiàn)單路視頻數(shù)據(jù)的實(shí)時(shí)采集和輸出。本系統(tǒng)設(shè)計(jì)簡(jiǎn)單,調(diào)試方便。只需適當(dāng)?shù)馗淖償?shù)據(jù)塊的長(zhǎng)度和FIFO的容量就可以應(yīng)用于其他的視頻處理系統(tǒng)。仿真測(cè)試結(jié)果表明:SDRAM時(shí)鐘頻率工作在71MHz下可以確保視頻流的流暢性。而且通過改變FIFO的相關(guān)參數(shù),還可以繼續(xù)提高SDRAM的實(shí)際帶寬。本設(shè)計(jì)還具有一定的靈活性。
[Abstract]:The paper introduces a video buffer design method of dual port FPGA and SDRAM based on the use of small capacity of synchronous and asynchronous FIFO FIFO series of user interface, the block read and write a single block of memory SDRAM, the hybrid algorithm reasonable arbitration read, write and refresh requests, real-time data acquisition and output of single channel video data. This system has the advantages of simple design, convenient debugging. Only appropriate to change the length of the data block and the capacity of FIFO can be applied to other video processing system. The simulation results show that: SDRAM clock work can ensure the smooth video stream in 71MHz. And the related parameters by changing the FIFO, can continue to improve the actual bandwidth of SDRAM. The design also has a certain degree of flexibility.

【作者單位】： 貴州財(cái)經(jīng)大學(xué)信息學(xué)院;
【分類號(hào)】：TP333
【正文快照】： 1引言在多數(shù)的基于FPGA(Field ProgrammableGate Arrays)的視頻處理系統(tǒng)中,通常需要使用片外大容量存儲(chǔ)器SDRAM(SynchronousDynamic Random Access Memory)緩存海量視頻資料[1-2]。同時(shí)為了確保視頻流的流暢性,甚至使用多塊SDRAM內(nèi)存和大容量的FIFO(First In First Out)實(shí)現(xiàn)乒

【參考文獻(xiàn)】

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本文編號(hào)：1488565