本文關(guān)鍵詞：基于MIC平臺(tái)的offload并行方法研究　出處：《計(jì)算機(jī)科學(xué)》2014年S1期 　論文類(lèi)型：期刊論文

  更多相關(guān)文章： 并行計(jì)算 MIC offload模式 協(xié)處理器

【摘要】：隨著并行計(jì)算的快速發(fā)展,開(kāi)始出現(xiàn)了專用于并行計(jì)算加速的協(xié)處理器。通過(guò)對(duì)新推出的MIC架構(gòu)協(xié)處理器的編程模式研究,描述了MIC平臺(tái)下的應(yīng)用模式,研究了不同應(yīng)用模式各自的特點(diǎn)和適用范圍,并深入研究了offload編程模式,提出了基于MIC平臺(tái)offload編程模式的開(kāi)發(fā)策略,為快速、高效地實(shí)現(xiàn)MIC并行程序的移植和加速提供了解決思路。
[Abstract]:With the rapid development of parallel computing, began a dedicated to the parallel computing coprocessor acceleration. Through the research on the programming model of MIC architecture processor new, describes the application mode of MIC platform, studied the characteristics of different application modes and their scope of application, and in-depth study of the offload programming model is proposed. The development strategy of MIC platform offload programming model based on MIC parallel program for fast, efficient and accelerated transplantation provides a solution.

【作者單位】： 浪潮集團(tuán)高效能服務(wù)器和存儲(chǔ)技術(shù)國(guó)家重點(diǎn)實(shí)驗(yàn)室;
【基金】：國(guó)家863項(xiàng)目:浪潮億級(jí)并發(fā)云服務(wù)器系統(tǒng)研制(2013AA01A208)資助
【分類(lèi)號(hào)】：TP338.6;TP311.11
【正文快照】： 1引言近幾年來(lái),隨著CPU制造工藝已經(jīng)接近極限[1],頻率難以進(jìn)一步提升,制造廠商的策略轉(zhuǎn)為在芯片中集成越來(lái)越多的計(jì)算核心。在高性能計(jì)算領(lǐng)域已有一定發(fā)展的并行計(jì)算應(yīng)用隨著多核CPU的普及而更具規(guī)模[2]。然而,人類(lèi)對(duì)計(jì)算的需求是無(wú)止境的[3],CPU的核心數(shù)從硬件上制約了應(yīng)用的

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