本文關(guān)鍵詞：實(shí)時(shí)系統(tǒng)中基于DVS與Cache劃分技術(shù)的節(jié)能研究　出處：《東北大學(xué)學(xué)報(bào)(自然科學(xué)版)》2011年12期 　論文類型：期刊論文

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【摘要】：DVS(動(dòng)態(tài)電壓調(diào)度)和cache劃分是用來(lái)節(jié)約嵌入式系統(tǒng)能耗的技術(shù).兩種技術(shù)的結(jié)合會(huì)具有更好的節(jié)能效果,而且有cache劃分的其他優(yōu)點(diǎn),關(guān)鍵問(wèn)題是如何為每個(gè)任務(wù)確定執(zhí)行時(shí)的電壓和cache大小來(lái)使系統(tǒng)能耗最小.在實(shí)時(shí)嵌入式系統(tǒng)中針對(duì)這一問(wèn)題,提出了一個(gè)多項(xiàng)式時(shí)間復(fù)雜度算法.實(shí)驗(yàn)對(duì)比了多組測(cè)試集在不同算法下的能耗,結(jié)果表明,本算法在滿足實(shí)時(shí)性約束條件下有效地降低系統(tǒng)能耗.
[Abstract]:DVS (dynamic Voltage scheduling) and cache partitioning are the technologies used to save the energy consumption of embedded systems. The combination of the two technologies will have better energy-saving effect and have other advantages of cache partitioning. The key problem is how to determine the execution voltage and cache size for each task to minimize system energy consumption. This problem is addressed in real-time embedded systems. A polynomial time complexity algorithm is proposed, and the energy consumption of multiple test sets under different algorithms is compared. The results show that the proposed algorithm can effectively reduce the system energy consumption under real-time constraints.
【作者單位】： 東北大學(xué)信息科學(xué)與工程學(xué)院;
【基金】：國(guó)家自然科學(xué)基金資助項(xiàng)目(60973017) 中央高�；究蒲袠I(yè)務(wù)費(fèi)專項(xiàng)資金資助項(xiàng)目(N100604010,N100204001)
【分類號(hào)】：TP316.2
【正文快照】： 節(jié)能是采用電池供電嵌入式系統(tǒng)的關(guān)鍵問(wèn)題.DVS[1]技術(shù)通過(guò)降低CPU的電壓/頻率來(lái)達(dá)到節(jié)能的目的.一般CPU是在有限個(gè)電壓/頻率級(jí)別下工作.但是,在實(shí)時(shí)系統(tǒng)中任務(wù)要滿足時(shí)間約束,而降低CPU電壓/頻率會(huì)延長(zhǎng)任務(wù)執(zhí)行時(shí)間,所以既要滿足系統(tǒng)實(shí)時(shí)性,又要最小化能耗.隨著嵌入式系統(tǒng)中

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本文編號(hào)：1403195