XOR網(wǎng)絡功耗優(yōu)化及在有限域乘法器上的應用
本文關鍵詞:XOR網(wǎng)絡功耗優(yōu)化及在有限域乘法器上的應用 出處:《寧波大學》2014年碩士論文 論文類型:學位論文
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【摘要】:隨著集成電路技術的不斷發(fā)展,電路的功耗已經成為集成電路設計過程中必須關注的問題之一。目前數(shù)字電路設計以NOT/AND/OR門為基礎的Boolean邏輯實現(xiàn),并已建立了系統(tǒng)的自動設計方法。事實上大量的研究表明,相比于用傳統(tǒng)Boolean邏輯實現(xiàn)的電路,約一半的電路,如用基于XOR/AND的Reed-Muller(RM)邏輯來實現(xiàn),可以實現(xiàn)電路面積的進一步優(yōu)化,并且RM邏輯在可測試性方面具有明顯的優(yōu)勢。相比于RM邏輯的面積優(yōu)化,涉及RM邏輯的功耗優(yōu)化要困難許多,這與RM邏輯對輸入信號的跳變十分敏感有關。本文將結合RM邏輯電路特點,通過對目前國內外RM邏輯功耗估算方法及優(yōu)化方法分析,提出了基于信號跳變密度的功耗估算方法,并且將該方法應用到有限域乘法器當中獲得了有效的驗證。論文主要包含以下三方面內容: 1、提出新的二輸入XOR門的信號跳變密度計算公式。對于CMOS電路來說,,功耗的絕大部分來源于動態(tài)功耗,而動態(tài)功耗的高低與單位時間內節(jié)點電容的充放電次數(shù)直接相關。在估算電路功耗的過程中,電路的開關活動性是估算功耗的重要指標,開關活動性的計算結果的準確程度將直接影響到功耗估算的準確性。本文通過隨機信號獲得信號的跳變密度的初始值,并推導出二輸入XOR門的信號跳變密度計算公式,同時也給出了實驗驗證的方法。 2、將XOR網(wǎng)絡分解為多個二輸入XOR門,并利用之前提出的二輸入XOR門的功耗估算方法實現(xiàn)XOR網(wǎng)絡的低功耗分解。并利用Modelsim軟件對分解后的XOR的信號跳變情況進行模擬驗證。實驗結果表明,所提出的算法在XOR網(wǎng)絡分解優(yōu)化方面比現(xiàn)有方法更有效。 3、有限域乘法器是通信系統(tǒng)重要的基本單元,目前為止國內外在有限域乘法器的研究主要集中在面積和速度優(yōu)化上面。為此,本文將提出的XOR網(wǎng)絡優(yōu)化算法應用在所建立得有限域乘法器模型上,通過Linux平臺上的DC綜合軟件分析XOR網(wǎng)絡所占乘法器的功耗比例,對比優(yōu)化前后的有限域乘法器的功耗,證明了本文提出的XOR網(wǎng)絡功耗優(yōu)化方法的有效性。
[Abstract]:With the continuous development of integrated circuit technology, the power consumption of the circuit has become one of the problems that must be paid attention to in the design of integrated circuits. At present, the design of digital circuit is based on the Boolean logic based on the NOT/AND/OR gate, and the automatic design method of the system has been established. A large number of studies show that in fact, compared to the traditional Boolean logic circuit implementation, about half of the circuit based on XOR/AND, such as Reed-Muller (RM) logic to achieve, can achieve further optimization of circuit area, and the RM logic has obvious advantages in terms of testability. Compared to the area optimization of RM logic, it is very difficult to optimize the power consumption of RM logic, which is very sensitive to the jump of the input signal by RM logic. This paper will combine the characteristics of RM logic circuit. By analyzing the current RM logic power consumption estimation methods and optimization methods at home and abroad, we propose a power estimation method based on the signal skip density, and apply this method to the finite field multiplier, which has been effectively verified. The paper mainly contains the following three aspects:
【學位授予單位】:寧波大學
【學位級別】:碩士
【學位授予年份】:2014
【分類號】:TP332.22;TN432
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本文編號:1342796
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