本文關(guān)鍵詞：基于FPGA的DDR控制器的設(shè)計(jì)

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【摘要】：DDR SDRAM使用雙倍數(shù)據(jù)速率結(jié)構(gòu),憑借其大容量,高數(shù)據(jù)傳輸速率和低成本優(yōu)勢,正在被越來越多地應(yīng)用于高速數(shù)據(jù)采集系統(tǒng)中[1]。使用Altera公司的Cyclone FPGA芯片設(shè)計(jì)實(shí)現(xiàn)了DDR控制器的功能,敘述了其設(shè)計(jì)思想,具有一定的實(shí)用價值。
【作者單位】： 大連民族大學(xué)信息與通信工程學(xué)院;
【基金】：中央高�；究蒲袠I(yè)務(wù)費(fèi)專項(xiàng)資金資助項(xiàng)目(DC201501058) 大學(xué)生創(chuàng)新訓(xùn)練項(xiàng)目(XA201611293)
【分類號】：TP333
【正文快照】： 0引言隨著電子技術(shù)的快速發(fā)展,人們對DDR(全稱DDRSDRAM)[2]的需求越來越緊迫。DDR(Double Data RateSynchronous Dynamic Random Access Memory,雙倍速率隨機(jī)存儲器)在設(shè)計(jì)上采用的是2.5 V的工作電壓,而且允許在時鐘的上升沿和下降沿進(jìn)行數(shù)據(jù)的存取,整體速度已可達(dá)到同頻率的2

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本文編號：1243350