本文關(guān)鍵詞：USB3.0數(shù)據(jù)鏈路層并行遞推CRC設(shè)計(jì)

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【摘要】：USB3.0為PC與各種設(shè)備的連接提供了一個(gè)標(biāo)準(zhǔn)接口。具有后向兼容、高速、穩(wěn)定,即插即用等特點(diǎn),得到了市場的廣泛認(rèn)可與普及。廣泛應(yīng)用于電子通信、光纖傳輸、圖像采集等領(lǐng)域。近年來,隨著高速數(shù)據(jù)傳輸需求日益增加。USB3.0中傳統(tǒng)的串行CRC校驗(yàn)很難滿足高速傳輸需求。為此,本文圍繞USB3.0數(shù)據(jù)鏈路層數(shù)據(jù)包CRC校驗(yàn)展開工作。論文分為理論分析和設(shè)計(jì)實(shí)現(xiàn)兩個(gè)部分。理論部分,首先從USB3.0協(xié)議出發(fā),簡單介紹了協(xié)議概述、數(shù)據(jù)包、數(shù)據(jù)傳輸類型等。重點(diǎn)對USB3.0的鏈路層的功能、總線結(jié)構(gòu)、鏈路層的數(shù)據(jù)包結(jié)構(gòu)、鏈路命令字、鏈路訓(xùn)練和狀態(tài)機(jī)等進(jìn)行了分析。設(shè)計(jì)和實(shí)現(xiàn)部分,先對CRC校驗(yàn)分析,USB3.0數(shù)據(jù)鏈路層中傳統(tǒng)CRC校驗(yàn)為串行設(shè)計(jì),為了提高傳輸速度需提高時(shí)鐘頻率,但是由于現(xiàn)有工藝條件限制了時(shí)鐘頻率的進(jìn)一步提高,進(jìn)而限制了USB3.0數(shù)據(jù)傳輸速度的提升。后分別對鏈路層數(shù)據(jù)頭包中的CRC-16和鏈路層數(shù)據(jù)負(fù)載包中的CRC-32設(shè)計(jì)。對數(shù)據(jù)負(fù)載包中的CRC-32進(jìn)行串行設(shè)計(jì)、并行查表設(shè)計(jì)。由于并行查表CRC-32需占用一定的表空間,工作時(shí)需反復(fù)查表降低了運(yùn)算速度。在串行CRC-32算法和并行查表CRC-32算法的基礎(chǔ)上導(dǎo)出了新的并行遞推CRC-32算法,該算法與現(xiàn)有并行查表CRC算法相比節(jié)省了存儲(chǔ)余數(shù)表的空間,節(jié)省了查表時(shí)間,提高了運(yùn)算速度。最后用Verilog實(shí)現(xiàn)了該算法。
【關(guān)鍵詞】：USB3.0 數(shù)據(jù)鏈路層 并行遞推CRC-32校驗(yàn) FPGA驗(yàn)證
【學(xué)位授予單位】：安徽大學(xué)
【學(xué)位級別】：碩士
【學(xué)位授予年份】：2016
【分類號(hào)】：TP334.7
【目錄】：

• 摘要3-4
• Abstract4-7
• 第一章 緒論7-9
• 1.1 論文課題研究的背景7-8
• 1.2 論文研究內(nèi)容及組織結(jié)構(gòu)8-9
• 第二章 USB3.0系統(tǒng)結(jié)構(gòu)和數(shù)據(jù)傳輸概述9-16
• 2.1 USB3.0的系統(tǒng)概述以及同USB2.0的比較9-11
• 2.2 USB3.0的協(xié)議分析11-16
• 2.2.1 USB3.0協(xié)議概述11-12
• 2.2.2 USB3.0包結(jié)構(gòu)介紹12-13
• 2.2.3 USB3.0數(shù)據(jù)傳輸類型13-16
• 第三章 USB3.0數(shù)據(jù)鏈路層分析16-31
• 3.1 USB3.0總線分析16-17
• 3.2 USB3.0鏈路層的包結(jié)構(gòu)以及功能17-24
• 3.2.1 USB3.0鏈路層的數(shù)據(jù)包結(jié)構(gòu)18-19
• 3.2.2 鏈路命令包19-20
• 3.2.3 USB3.0鏈路控制20-23
• 3.2.4 USB3.0鏈路層的功能23-24
• 3.3 鏈路訓(xùn)練和狀況狀態(tài)機(jī)24-31
• 3.3.1 非超速狀態(tài)26
• 3.3.2 超速失敗狀態(tài)26-27
• 3.3.3 上電狀態(tài)27-28
• 3.3.4 輪詢狀態(tài)28-29
• 3.3.5 熱復(fù)位狀態(tài)29-31
• 第四章 USB3.0數(shù)據(jù)鏈路層CRC設(shè)計(jì)31-39
• 4.1 USB3.0中CRC校驗(yàn)原理31-32
• 4.2 USB3.0數(shù)據(jù)鏈路層包頭中CRC-16校驗(yàn)設(shè)計(jì)32-35
• 4.2.1 CRC-16電路實(shí)現(xiàn)32-33
• 4.2.2 算法實(shí)現(xiàn)過程33-35
• 4.3 USB3.0數(shù)據(jù)鏈路層數(shù)據(jù)包中CRC-32校驗(yàn)設(shè)計(jì)35-39
• 4.3.1 CRC-32電路實(shí)現(xiàn)35-37
• 4.3.2 并行遞推CRC-32算法實(shí)現(xiàn)37-39
• 第五章 USB3.0數(shù)據(jù)鏈路層CRC校驗(yàn)的實(shí)現(xiàn)39-44
• 5.1 數(shù)據(jù)包頭中CRC-16的實(shí)現(xiàn)39-41
• 5.1.1 數(shù)據(jù)包頭中串行CRC-16的verilog實(shí)現(xiàn)39-40
• 5.1.2 數(shù)據(jù)包頭中并行CRC-16的verilog實(shí)現(xiàn)40-41
• 5.2 數(shù)據(jù)域中的CRC-32的實(shí)現(xiàn)和比較41-44
• 5.2.1 串行CRC-32的verilog實(shí)現(xiàn)41
• 5.2.2 并行遞推CRC-32的verilog實(shí)現(xiàn)41-42
• 5.2.3 并行查表CRC-32和并行遞推CRC-32仿真結(jié)果的比較42-44
• 第六章 總結(jié)與展望44-46
• 參考文獻(xiàn)46-49
• 圖表目錄49-50
• 致謝50

【相似文獻(xiàn)】

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1 林t燂，

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