本文關(guān)鍵詞：基于FPGA的處理器間高精度時(shí)鐘同步通信機(jī)制

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【摘要】：為了保證嵌入式設(shè)備運(yùn)行的穩(wěn)定性和可靠性,都會(huì)應(yīng)用雙余度的CPU來共同管理硬件資源,協(xié)調(diào)任務(wù)調(diào)度和處理CPU的高速外設(shè)接口數(shù)據(jù),因此,該文介紹一種在具有高效數(shù)字時(shí)鐘管理器的FPGA上產(chǎn)生高精度、高穩(wěn)定度時(shí)鐘同步信號(hào),用來保證CPU間的精確同步通信,達(dá)到高效的公共資源管理、合理的任務(wù)調(diào)度以及相互比對(duì)的數(shù)據(jù)計(jì)算。
【作者單位】： 中航工業(yè)西安航空計(jì)算技術(shù)研究所;駐六三一所軍事代表室;
【關(guān)鍵詞】： FPGA 同步通信 處理器 時(shí)鐘信號(hào)
【基金】：航空基金項(xiàng)目(20121931002)
【分類號(hào)】：TP332
【正文快照】： 隨著現(xiàn)代半導(dǎo)體技術(shù)的不斷發(fā)展,具有高性能、低功耗和接口資源豐富處理器的數(shù)據(jù)處理模塊越來越多地應(yīng)用到了嵌入式領(lǐng)域內(nèi)。本文著重介紹了一種高精度、高穩(wěn)定的脈沖同步通信機(jī)制,其應(yīng)用到高性能數(shù)據(jù)處理模塊的雙處理器之間,保證雙處理器的任務(wù)調(diào)度平衡和處理數(shù)據(jù)保證一致性,進(jìn)

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本文編號(hào)：1014418