本文關(guān)鍵詞：高精度Sigma-Delta調(diào)制器的建模設計

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【摘要】：基于MATLAB Simulink設計實現(xiàn)了一款單環(huán)三階一位量化CIFF(Cascade-of-integrators,feedforward form)結(jié)構(gòu)的高精度Sigma-Delta調(diào)制器.通過對噪聲傳輸函數(shù)和系統(tǒng)反饋系數(shù)進行優(yōu)化,提高了調(diào)制器的穩(wěn)定性;分析了開關(guān)電容電路的主要誤差影響,為電路實現(xiàn)提供可靠的設計指導.仿真結(jié)果顯示,在輸入信號帶寬為75Hz,過采樣率為512時,理想調(diào)制器輸出SNR高達148.3dB,ENOB為24.34bit;考慮非理想因素時,ENOB為22.02bit;電路級實現(xiàn)的調(diào)制器ENOB達20.94bit,表明該設計可實現(xiàn)低信號帶寬下高精度轉(zhuǎn)換.
【作者單位】： 合肥工業(yè)大學微電子設計研究所;
【關(guān)鍵詞】： Sigma-Delta調(diào)制器 高精度 CIFF 噪聲傳輸函數(shù) 非理想因素
【基金】：中央高�；究蒲袠I(yè)務費專項資金項目(2014HGCH0010)
【分類號】：TN761
【正文快照】： 1引言采用噪聲整形技術(shù)和過采樣技術(shù)的Sigma-Del-ta ADC具有很多優(yōu)點,例如,對元器件失配容忍能力強,線性度和精度高等,因而得到了廣泛的應用.作為Sigma-Delta ADC的核心組成,采用高階單環(huán)多位量化或級聯(lián)結(jié)構(gòu)的Sigma-Delta調(diào)制器正朝著低功耗高精度的方向發(fā)展.文獻[1]采用單環(huán)

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本文編號：909598