發(fā)布時(shí)間：2017-09-17 10:27

  本文關(guān)鍵詞：基于憶阻器蘊(yùn)含門的邏輯電路綜合進(jìn)化算法

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【摘要】：為了減小電路延遲,提出基于憶阻器蘊(yùn)含門的邏輯電路綜合多階段進(jìn)化算法(IMP-ELS),求得在工作憶阻器數(shù)目取不同值的條件下的脈沖數(shù)優(yōu)化電路.將問(wèn)題建模為等式約束下的最小化問(wèn)題,當(dāng)約束違反降低到一定程度時(shí),通過(guò)判別當(dāng)前最優(yōu)解與待求函數(shù)真值表符合的條件,計(jì)算與、或、異或三種余項(xiàng)函數(shù)之一,將其作為新的待求函數(shù),啟動(dòng)新一輪進(jìn)化,從而保證得到電路的可行解;設(shè)計(jì)蘊(yùn)含門邏輯電路編碼及初始化方法,減少隨機(jī)初始化種群中的非法解和冗余門.對(duì)2~11bit標(biāo)準(zhǔn)邏輯函數(shù)測(cè)試結(jié)果表明:當(dāng)工作憶阻器數(shù)目由2增大到3時(shí),該算法對(duì)82%的測(cè)試函數(shù)平均脈沖數(shù)降低了28%.
【作者單位】： 西安電子科技大學(xué)電子工程學(xué)院;西安石油大學(xué)計(jì)算機(jī)學(xué)院;
【關(guān)鍵詞】： 憶阻器 實(shí)質(zhì)蘊(yùn)含 邏輯電路綜合 進(jìn)化算法 余項(xiàng)函數(shù)
【基金】：國(guó)家重點(diǎn)基礎(chǔ)研究發(fā)展計(jì)劃資助項(xiàng)目(2013CB329402) 國(guó)家自然科學(xué)基金資助項(xiàng)目(61272279,61203303,61371201)
【分類號(hào)】：TN791
【正文快照】： HP(惠普公司)實(shí)驗(yàn)室在開(kāi)發(fā)替代晶體管開(kāi)關(guān)的分子級(jí)產(chǎn)品時(shí)開(kāi)發(fā)出納米憶阻器[1],并利用雙憶阻器的開(kāi)關(guān)特性實(shí)現(xiàn)了實(shí)質(zhì)蘊(yùn)含操作[2].實(shí)質(zhì)蘊(yùn)含是兩變量基本邏輯運(yùn)算之一,與邏輯常量0一起構(gòu)成邏輯運(yùn)算的完備基,這意味著利用憶阻器實(shí)質(zhì)蘊(yùn)含操作可以實(shí)現(xiàn)任意邏輯運(yùn)算.若將其與憶阻器的

【相似文獻(xiàn)】

中國(guó)期刊全文數(shù)據(jù)庫(kù) 前10條

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4 陳開(kāi)中;肖芳英;李志強(qiáng);陳漢武;;基于群論的可逆邏輯電路綜合方法的研究[A];全國(guó)第十三次光纖通信暨第十四屆集成光學(xué)學(xué)術(shù)會(huì)議論文集[C];2007年

5 袁小龍;張文淵;郄利波;;一種新的邏輯電路初始劃分算法[A];計(jì)算機(jī)技術(shù)與應(yīng)用進(jìn)展——全國(guó)第17屆計(jì)算機(jī)科學(xué)與技術(shù)應(yīng)用（CACIS）學(xué)術(shù)會(huì)議論文集（下冊(cè)）[C];2006年

6 陳婷婷;李哲英;;USB2．0數(shù)據(jù)傳輸環(huán)節(jié)邏輯電路低功耗設(shè)計(jì)[A];全國(guó)第十屆信號(hào)與信息處理、第四屆DSP應(yīng)用技術(shù)聯(lián)合學(xué)術(shù)會(huì)議論文集[C];2006年

7 白德風(fēng);呂長(zhǎng)志;張U，

本文編號(hào)：868885